參數(shù)資料
| 型號： | EP20K300EQC240-3 |
| 廠商： | Altera |
| 文件頁數(shù)： | 79/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC APEX 20KE FPGA 300K 240-PQFP |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 24 |
| 系列： | APEX-20K® |
| LAB/CLB數(shù)： | 1152 |
| 邏輯元件/單元數(shù)： | 11520 |
| RAM 位總計： | 147456 |
| 輸入/輸出數(shù)： | 152 |
| 門數(shù)： | 728000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 240-BFQFP |
| 供應商設備封裝： | 240-PQFP（32x32） |
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64
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Table 29. APEX 20KE Device DC Operating Conditions
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIH
High-level LVTTL, CMOS, or 3.3-V
PCI input voltage
1.7, 0.5
× VCCIO
4.1
V
VIL
Low-level LVTTL, CMOS, or 3.3-V
PCI input voltage
–0.5
0.8, 0.3
× VCCIO
V
VOH
3.3-V high-level LVTTL output
voltage
IOH = –12 mA DC,
2.4
V
3.3-V high-level LVCMOS output
voltage
IOH = –0.1 mA DC,
VCCIO –0.2
V
3.3-V high-level PCI output voltage IOH = –0.5 mA DC,
VCCIO = 3.00 to 3.60 V
0.9
× VCCIO
V
2.5-V high-level output voltage
IOH = –0.1 mA DC,
2.1
V
IOH = –1 mA DC,
2.0
V
IOH = –2 mA DC,
1.7
V
VOL
3.3-V low-level LVTTL output
voltage
IOL = 12 mA DC,
0.4
V
3.3-V low-level LVCMOS output
voltage
IOL = 0.1 mA DC,
0.2
V
3.3-V low-level PCI output voltage IOL = 1.5 mA DC,
VCCIO = 3.00 to 3.60 V
0.1
× VCCIO
V
2.5-V low-level output voltage
IOL = 0.1 mA DC,
0.2
V
IOL = 1 mA DC,
0.4
V
IOL = 2 mA DC,
0.7
V
II
Input pin leakage current
–10
10
A
IOZ
Tri-stated I/O pin leakage current
–10
10
A
ICC0
VCC supply current (standby)
(All ESBs in power-down mode)
VI = ground, no load, no
toggling inputs, -1 speed
grade
10
mA
VI = ground, no load, no
toggling inputs,
-2, -3 speed grades
5mA
RCONF
Value of I/O pin pull-up resistor
before and during configuration
20
50
k
30
80
k
60
150
k
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| EP20K300EQI240-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K300EQI240-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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