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參數(shù)資料
| 型號(hào)： | EP20K160E |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可編程邏輯器件系列 |
| 文件頁(yè)數(shù)： | 71/117頁(yè) |
| 文件大?。?/td> | 570K |
| 代理商： | EP20K160E |
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Altera Corporation
71
APEX 20K Programmable Logic Device Family Data Sheet
Figure 39. ESB Synchronous Timing Waveforms
Figure 40
shows the timing model for bidirectional I/O pin timing.
WE
CLK
ESB Synchronous Read
a0
d2
t
ESBDATASU
t
ESBARC
ESBDATACO2
a1
a2
a3
d1
t
ESBDATAH
a0
WE
CLK
dout0
din1
din2
din3
din2
t
ESBWESU
t
ESBSWC
t
ESBWEH
t
ESBDATACO1
a1
a2
a3
a2
din3
din2
din1
t
ESBDATAH
t
ESBDATASU
ESB Synchronous Write (ESB Output Registers Used)
dout1
Rdaddress
Data-Out
Wraddress
Data-Out
Data-In
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K200 | Programmable Logic Device Family |
| EP20K200E | Programmable Logic Device Family |
| EP20K300E | Programmable Logic Device Family |
| EP20K30E | Programmable Logic Device Family |
| EP20K400 | Programmable Logic Device Family |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EP20K160EBC356-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K160EBC356-1N | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 CPLD - APEX 20K 640 Macro 271 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K160EBC356-1X | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 CPLD - APEX 20K 640 Macro 271 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K160EBC356-2 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 CPLD - APEX 20K 640 Macro 271 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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