Stratix GX devices combin" />
參數(shù)資料
型號： EP1SGX25DF1020C7N
廠商： Altera
文件頁數(shù)： 997/1456頁
文件大小： 0K
描述： IC STRATIX GX FPGA 25K 1020-FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 12
系列： Stratix® GX
LAB/CLB數(shù)： 2566
邏輯元件/單元數(shù)： 25660
RAM 位總計： 1944576
輸入/輸出數(shù)： 607
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應商設備封裝： 1020-FBGA（33x33）
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Altera Corporation
1–1
June 2006
1. Introduction
Introduction
Stratix GX devices combine highly advanced 3.1875-gigabit-per-second
(Gbps) four-channel gigabit transceiver blocks with one of the industry’s
most advanced FPGA architectures. Stratix GX devices are manufactured
on a 1.5-V, 0.13-m, all-layer copper CMOS process technology with 1.5-
V PCML I/O standard support.
Historically, designers have used high-speed transceivers in strictly
structured, line-side applications. Now, with the new gigabit transceiver
blocks embedded in FPGAs, you can use transceivers in a host of new
systems that require flexibility, increased time-to-market, high
performance, and top-of-the-line features.
Gigabit
Transceiver
Block Highlights
Stratix GX devices are organized into four-channel blocks with four
3.1875 Gbps full-duplex channels per block and up to 20 channels (in five
blocks) per device. Each self-contained Stratix GX gigabit transceiver
block supports a variety of embedded functions and does the following:
■
Supports frequencies from 500 megabits per second (Mbps) to
3.1875 Gbps
■
Integrates serializer/deserializer (SERDES), clock data recovery
(CDR), word aligner, channel aligner, rate matcher, 8B/10B
encoder/decoder, byte serializer/deserializer, and phase
compensation first-in first-out (FIFO) modules
■
Supports flexible reference clock generation capabilities, including a
dedicated transmitter phase-locked loop (PLL) and four receiver
PLLs per gigabit transceiver block
■
Supports programmable pre-emphasis, equalization, and
programmable VOD settings in I/O buffers, and dynamic
reprogrammability for each of these features
■
Implements XAUI physical media attachment (PMA) and physical
coding sublayer (PCS) functionality for 10GBASE-X systems
■
Provides built-in Gigabit Ethernet (GigE) physical coding sublayer
functionality
■
Provides individual transmitter and receiver power-down capability
for reduced power consumption during non-operation
■
Includes built-in self test (BIST) capability, including embedded
Pseudo Random Binary Sequence (PRBS) pattern generation and
verification
■
Includes three independent loopback paths for system verification
SGX52001-1.2
相關PDF資料
PDF描述
RCB100DHAD CONN EDGECARD 200PS R/A .050 DIP
EP2SGX30CF780C3 IC STRATIX II GX 30K 780-FBGA
A1280A-1PL84C IC FPGA 8K GATES 84-PLCC COM
DS2431G+U IC EEPROM 1024BIT 2SFN
A1280A-1PLG84C IC FPGA 8K GATES 84-PLCC COM
相關代理商/技術(shù)參數(shù)
參數(shù)描述
EP1SGX25DF672C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 2566 LABs 455 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX25DF672C5N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 2566 LABs 455 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX25DF672C6 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 2566 LABs 455 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX25DF672C6N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 2566 LABs 455 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1SGX25DF672C6NGA 制造商:Altera Corporation 功能描述:
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