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參數(shù)資料
| 型號： | EP1S80F1508C7ES |
| 廠商： | Altera Corporation |
| 英文描述： | Stratix Device Family Data Sheet |
| 中文描述： | Stratix系列器件數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 152/290頁 |
| 文件大?。?/td> | 3559K |
| 代理商： | EP1S80F1508C7ES |
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2–128
Stratix Device Handbook, Volume 1
Altera Corporation
July 2005
I/O Structure
Figure 2–71. LVDS Input Differential On-Chip Termination
I/O banks on the left and right side of the device support LVDS receiver
(far-end) differential termination.
Table 2–33
shows the Stratix device differential termination support.
Table 2–34
shows the termination support for different pin types.
The differential on-chip resistance at the receiver input buffer is
118
Ω
±
20 %.
R
D
+
D
+
D
Transmittin
g
Device
Receivin
g
Device with
Differential Termination
Z
0
Z
0
Table 2–33. Differential Termination Supported by I/O Banks
Differential Termination Support
I/O Standard Support
Top & Bottom
Banks (3, 4, 7 & 8)
Left & Right Banks
(1, 2, 5 & 6)
v
Differential termination
(1)
,
(2)
LVDS
Notes to
Table 2–33
:
(1)
Clock pin
CLK0
,
CLK2
,
CLK9
,
CLK11
,
and pins
FPLL[7..10]CLK
do not support differential termination.
(2)
Differential termination is only supported for LVDS because of a 3.3-V V
CCIO
.
Table 2–34. Differential Termination Support Across Pin Types
Pin Type
R
D
Top and bottom I/O banks (3, 4, 7, and 8)
DIFFIO_RX[]
v
CLK[0,2,9,11],CLK[4-7],CLK[12-15]
CLK[1,3,8,10]
v
FCLK
FPLL[7..10]CLK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K100 | Programmable Logic Device Family |
| EP20K1000E | Programmable Logic Device Family |
| EP20K100E | Programmable Logic Device Family |
| EP20K1500E | Programmable Logic Device Family |
| EP20K160E | Programmable Logic Device Family |
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參數(shù)描述 |
|---|---|
| EP1S80F1508C7N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S80F1508I5ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508I6ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508I7 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S80F1508I7ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
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