參數(shù)資料
型號： EP1S60F1508C6N
廠商： Altera
文件頁數(shù)： 213/864頁
文件大?。?/td> 0K
描述： IC STRATIX FPGA 60K LE 1508-FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標準包裝： 7
系列： Stratix®
LAB/CLB數(shù)： 5712
邏輯元件/單元數(shù)： 57120
RAM 位總計： 5215104
輸入/輸出數(shù)： 1022
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1508-BBGA
供應商設備封裝： 1508-FBGA（30x30）
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Index–4
Altera Corporation
Stratix Device Handbook, Volume 1
Fast Regional Clock External I/O Timing
Parameters 4–49
Global
Clock
External
I/O
Timing
Parameters 4–50
Regional Clock External I/O Timing
Parameters 4–50
EP1S60 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–51
Global
Clock
External
I/O
Timing
Parameters 4–52
Regional Clock External I/O Timing
Parameters 4–51
M-RAM
Interface Locations 2–38
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–52
Global
Clock
External
I/O
Timing
Parameters 4–53
Regional Clock External I/O Timing
Parameters 4–53
EP1S80 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–54
Global
Clock
External
I/O
Timing
Parameters 4–55
Regional Clock External I/O Timing
Parameters 4–54
Global
Clock
External
I/O
Timing
Parameters 4–56
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–55
Regional Clock External I/O Timing
Parameters 4–56
H
HSTL
Class I Specifications 4–14, 4–15
Class II Specifications 4–14, 4–15
I
I/O
Standards
I/O Specifications 4–4
1.8-V
I/O Specifications 4–4
2.5-V
I/O Specifications 4–3
3.3-V 4–13
LVDS I/O Specifications 4–6
PCI Specifications 4–9
PCML Specifications 4–8
Advanced I/O Standard Support 2–122
Column I/O Block Connection to the
Interconnect 2–107
Column Pin
Input Delay Adders 4–66
Control Signal Selection per IOE 2–109
CTT I/O Specifications 4–16
Differential
LVDS
Input
On-Chip
Termination 2–128
External I/O Delay Parameters 4–66
GTL+ I/O Specifications 4–10
High-Speed
Differential
I/O
Support 2–130
HyperTransport
Technology
Specifications 4–9
I/O Banks 2–125
I/O Structure 2–104
I/O Support by Bank 2–126
IOE Structure 2–105
LVCMOS Specifications 4–3
LVDS
Performance
on
Fast
PLL
Input 2–103
LVPECL Specifications 4–8
LVTTL Specifications 4–3
MultiVolt I/O Interface 2–129
MultiVolt I/O Support 2–130
Output Delay Adders for Fast Slew Rate
on Column Pins 4–68
Output Delay Adders for Fast Slew Rate
on Row Pins 4–69
Output Delay Adders for Slow Slew Rate
on Column Pins 4–70
Package Options & I/O Pin Counts 1–4
Receiver Input Waveforms for Differential
相關PDF資料
PDF描述
A54SX32-1CQ256 IC FPGA SX 48K GATES 256-CQFP
RSM43DRAH CONN EDGECARD 86POS R/A .156 SLD
RMM43DRAH CONN EDGECARD 86POS R/A .156 SLD
24AA01T-I/MC IC EEPROM 1KBIT 400KHZ 8DFN
24AA00T-I/MC IC EEPROM 128BIT 400KHZ 8DFN
相關代理商/技術參數(shù)
參數(shù)描述
EP1S60F1508C7 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S60F1508C7ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S60F1508C7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S60F1508I5ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S60F1508I6 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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