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Altera Corporation
Index–3
Stratix Device Handbook, Volume 1
Differential HSTL Specifications 4–15
DSP
Block Diagram
Configuration
for 18 x 18-Bit 2–55
for 9 x 9-Bit 2–56
Block Interconnect Interface 2–71
Block Interface 2–70
Block Signal Sources & Destinations 2–73
Blocks
Arranged in Columns 2–53
in Stratix Devices 2–54
Input Register Modes 2–60
Input Registers 2–58
Multiplier
Block 2–57
Signed Representation 2–60
Sub-Block 2–57
Sub-Blocks Using Input Shift Register
Connections 2–59
Pipeline/Post Multiply Register 2–61
E
EP1S10 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–36
Global
Clock
External
I/O
Timing
Parameters 4–37
Regional Clock External I/O Timing
Parameters 4–36
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–37
Global
Clock
External
I/O
Timing
Parameters 4–38
Regional Clock External I/O Timing
Parameters 4–38
EP1S20 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–39
Global
Clock
External
I/O
Timing
Parameters 4–40
Regional Clock External I/O Timing
Parameters 4–39
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–40
Global
Clock
External
I/O
Timing
Parameters 4–41
Regional Clock External I/O Timing
Parameters 4–41
EP1S25 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–42
Global
Clock
External
I/O
Timing
Parameters 4–43
Regional Clock External I/O Timing
Parameters 4–42
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–43
Global
Clock
External
I/O
Timing
Parameters 4–44
Regional Clock External I/O Timing
Parameters 4–44
EP1S30 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–45
Global
Clock
External
I/O
Timing
Parameters 4–45
Regional Clock External I/O Timing
Parameters 4–45
Row Pin
Fast Regional Clock External I/O Timing
Parameters 4–46
Global
Clock
External
I/O
Timing
Parameters 4–47
Regional Clock External I/O Timing
Parameters 4–47
EP1S40 Devices
Column Pin
Fast Regional Clock External I/O Timing
Parameters 4–48
Global
Clock
External
I/O
Timing
Parameters 4–49
Regional Clock External I/O Timing
Parameters 4–48
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相關(guān)PDF資料
PDF描述
A54SX32-1CQ256 IC FPGA SX 48K GATES 256-CQFP
RSM43DRAH CONN EDGECARD 86POS R/A .156 SLD
RMM43DRAH CONN EDGECARD 86POS R/A .156 SLD
24AA01T-I/MC IC EEPROM 1KBIT 400KHZ 8DFN
24AA00T-I/MC IC EEPROM 128BIT 400KHZ 8DFN
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP1S60F1508C7 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S60F1508C7ES 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S60F1508C7N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S60F1508I5ES 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S60F1508I6 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix I 5712 LABs 1022 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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