參數(shù)資料
型號(hào)： DSPIC30F2020T-30I/SO
廠商： Microchip Technology
文件頁數(shù)： 42/285頁
文件大?。?/td> 0K
描述： IC DSPIC MCU/DSP 12K 28SOIC
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 1
系列： dsPIC™ 30F
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 30 MIP
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 21
程序存儲(chǔ)器容量： 12KB（4K x 24）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 標(biāo)準(zhǔn)包裝
配用： DM300023-ND - KIT DEMO DSPICDEM SMPS BUCK
DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE
其它名稱： DSPIC30F2020T-30I/SODKR
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dsPIC30F1010/202X
DS70178C-page 134
Preliminary
2006 Microchip Technology Inc.
12.24 PWM Current-Limit Pins
Each PWM generator can select its own current-limit
input source from up to12 current-limit/Fault pins. In the
FCLCONx registers, each PWM generator has control
bits (CLSRC<3:0>) that specify the source for its cur-
rent-limit input signal. Additionally, each PWM genera-
tor has a CLIEN bit in the PWMCONx register that
enables
the
generation
of
current-limit
interrupt
requests. Each PWM generator has an associated
Fault polarity bit CLPOL in the FCLCONx register.
Figure 12-21 is a diagram of the PWM Current-Limit
control logic.
The current-limit pins actually serve two different pur-
poses. They can be used to implement either Current-
Limit PWM mode or Current Reset PWM mode.
1.
When the CLIEN bit is set in the PWMCONx
registers, the PWMxH,L outputs are forced to
the values specified by the CLDAT<1:0> bits in
the IOCONx register, if the selected current-limit
input signal is asserted.
2.
When the CLMOD bit is zero AND the XPRES
bit in the PWMCONx register is ‘01’ AND the
PWM generator is in Independent Time Base
mode (ITB
=
1
), then a current-limit signal
resets the time base for the affected PWM gen-
erator. This behavior is called Current Reset
mode, which is used in some Power Factor
Correction (PFC) applications.
12.24.1
CURRENT-LIMIT INTERRUPTS
The state of the PWM current-limit conditions is avail-
able on the CLSTAT bits in the PWMCONx registers.
The CLSTAT bits display the current-limit IRQ flag if
the CLIEN bit is set. If current-limit interrupts are not
enabled, then the CLSTAT bits display the status of the
selected current-limit inputs in positive logic format.
When the current-limit input pin associated with a
PWM generator is not used, these pins become
general purpose I/O or interrupt input pins.
The current-limit pins are normally active high. If set to
‘1’, the CLPOL bit in FCLCONx registers inverts the
selected current-limit input signal to active high.
The interrupts generated by the selected current-limit
signals are combined to create a single interrupt
request signal to the interrupt controller, which has its
own interrupt vector, interrupt flag bit, interrupt enable
bit and interrupt priority bits associated with it.
The Fault pins are also readable through the PORT I/O
logic when the PWM module is enabled. This allows
the user to poll the state of the Fault pins in software.
FIGURE 12-21:
PWM CURRENT-LIMIT CONTROL LOGIC DIAGRAM
PWMx
Generator
CLDAT<1:0>
PWMxH,L
Signals
2
MUX
Analog Comparator 1
Analog Comparator 2
Analog Comparator 3
Analog Comparator 4
CLSRC<3:0>
CMP1x
CMP2x
CMP3x
CMP4x
SFLT1
SFLT2
SFLT3
SFLT4
IFLT2
IFLT4
PWMxH,L
2
Shared Fault # 1
Shared Fault # 2
Shared Fault # 3
Shared Fault # 4
Independent Fault # 2
Independent Fault # 4
CLSTAT
XPRES
PWM Period
Reset
EN
Analog Comparator
Module
‘0000’
‘0001’
‘0010’
‘1000’
‘1001’
‘1010’
‘1011’
‘1101’
‘1111’
‘0011’
0
1
CLMOD
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