參數(shù)資料
型號： DS72611RP100FPV
廠商： Renesas Electronics America
文件頁數(shù)： 161/226頁
文件大?。?/td> 0K
描述： IC SUPERH MPU ROMLESS 176LQFP
產(chǎn)品培訓(xùn)模塊： CAN Basics Part-1
CAN Basics Part-2
Electromagnetic Noise Reduction Techniques Part 1
標(biāo)準(zhǔn)包裝： 1
系列： SuperH® SH7200
核心處理器： SH-2A
芯體尺寸： 32-位
速度： 100MHz
連通性： CAN，EBI/EMI，F(xiàn)IFO，I²C，SCI，串行聲控
外圍設(shè)備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 104
程序存儲器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b; D/A 2x8b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 176-LQFP
包裝： 托盤
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PIC18CXX2
DS39026C-page 262
2001 Microchip Technology Inc.
FIGURE 21-22:
A/D CONVERSION TIMING
TABLE 21-22: A/D CONVERSION REQUIREMENTS
Param
No.
Symbol
Characteristic
Min
Max
Units
Conditions
130
TAD
A/D clock period
PIC18CXXX
1.6
20(5)
sTOSC based, VREF ≥ 3.0V
PIC18LCXXX
3.0
20(5)
sTOSC based, VREF full range
PIC18CXXX
2.0
6.0
s
A/D RC mode
PIC18LCXXX
3.0
9.0
s
A/D RC mode
131
TCNV
Conversion time
(not including acquisition time) (Note 1)
11
12
TAD
132
TACQ
Acquisition time (Note 3)
15
10
—
s
-40
°C ≤ Temp ≤ 125°C
0
°C ≤ Temp ≤ 125°C
135
TSWC
Switching Time from convert
→ sample
—
(Note 4)
136
TAMP
Amplifier settling time (Note 2)
1
—
s
This may be used if the
“new” input voltage has not
changed by more than 1 LSb
(i.e., 5 mV @ 5.12V) from
the last sampled voltage (as
stated on CHOLD).
Note 1: ADRES register may be read on the following TCY cycle.
2: See Section 16.0 for minimum conditions, when input voltage has changed more than 1 LSb.
3: The time for the holding capacitor to acquire the “New” input voltage, when the voltage changes full scale
after the conversion (AVDD to AVSS, or AVSS to AVDD). The source impedance (RS) on the input channels is
50
.
4: On the next Q4 cycle of the device clock.
5: The time of the A/D clock period is dependent on the device frequency and the TAD clock divider.
131
130
132
BSF ADCON0, GO
Q4
A/D CLK
A/D DATA
ADRES
ADIF
GO
SAMPLE
OLD_DATA
SAMPLING STOPPED
DONE
NEW_DATA
Note 2
98
7
2
1
0
Note 1: If the A/D clock source is selected as RC, a time of TCY is added before the A/D clock starts.
This allows the SLEEP instruction to be executed.
2: This is a minimal RC delay (typically 100 ns), which also disconnects the holding capacitor from the analog input.
. . .
TCY
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PDF描述
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