參數資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數： 76/366頁
文件大小： 0K
描述： IC TDM OVER PACKET 484TEBGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： TDM（分時復用）
應用： 數據傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應商設備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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The TDM_cond_data_reg register below holds four octets to be transmitted as conditioning data in the TDM
direction (i.e. toward the cross-connection block) during jitter buffer underrun. This data applies to all bundle types.
TDM_cond_data_reg 0x30
Bits
Data Element Name
R/W
Reset
Value
Description
[31:24]
TDM_cond_octet_a
R/W
0x00
TDM Conditioning Octet A
Must be set to 0x7E for HDLC bundles
Also used in high-speed mode
[23:16]
TDM_cond_octet_b
R/W
0x00
TDM Conditioning Octet B
Must be set to 0x7E for HDLC bundles
[15:8]
TDM_cond_octet_c
R/W
0x00
TDM Conditioning Octet C
Must be set to 0x7E for HDLC bundles
[7:0]
TDM_cond_octet_d
R/W
0x00
TDM Conditioning Octet D
Must be set to 0x7E for HDLC bundles
The ETH_cond_data_reg register below holds four octets to be transmitted as conditioning data towards the packet
network (i.e. toward the Ethernet MAC) when no valid data is available from the TDM port. This applies only to
AAL1 or SAToP/CESoPSN bundles. Tx_cond_octet_type in the Bundle Configuration Tables specifies which of
these octets is used on a per-bundle basis.
ETH_cond_data_reg 0x34
Bits
Data Element Name
R/W
Reset
Value
Description
[31:24]
ETH_cond_octet_d
R/W
0x00
Ethernet Conditioning octet D
[23:16]
ETH_cond_octet_c
R/W
0x00
Ethernet Conditioning octet C
[15:8]
ETH_cond_octet_b
R/W
0x00
Ethernet Conditioning octet B
[7:0]
ETH_cond_octet_a
R/W
0x00
Ethernet Conditioning octet A
Packet_classifier_cfg_reg0 0x38
Bits
Data Element Name
R/W
Reset
Value
Description
[31:0]
Ipv4_add1
R/W
0x0
This field holds the first of three IPv4 addresses for the
device. The other addresses are held in register
Packet_classifier_cfg_reg1 and
Packet_classifier_cfg_reg8. Relevant only for packets
received from the Ethernet port.
Packet_classifier_cfg_reg1 0x3C
Bits
Data Element Name
R/W
Reset
Value
Description
[31:0]
Ipv4_add2
R/W
0x0
This field holds the second of three IPv4 addresses for the
device. The other addresses are held in register
Packet_classifier_cfg_reg0 and
Packet_classifier_cfg_reg8. Relevant only for packets
received from the Ethernet port.
Packet_classifier_cfg_reg2 0x40
Bits
Data Element Name
R/W
Reset
Value
Description
[31:0]
MAC_add1
R/W
0x0
This field holds bits 31:0 of the first of two MAC addresses
for the device. The upper bits of this MAC address are in
Packet_classifier_cfg_reg3. The other MAC address is in
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PDF描述
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DS34T102GN+ 功能描述:網絡控制器與處理器 IC Dual TDM Over Packet Chip RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網絡控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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