參數(shù)資料
型號： DS3182+
廠商： Maxim Integrated Products
文件頁數(shù)： 79/400頁
文件大?。?/td> 0K
描述： IC PHY ATM/PACKET DUAL 400-TEBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 4
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
17
3 FEATURE DETAILS
The following sections describe the features provided by the DS3181 (single), DS3182 (dual), DS3183 (triple), and
DS3184 (quad) PHYs.
3.1 Global Features
System interface configurable for UTOPIA L2/UTOPIA L3 for ATM cell traffic or POS-PHY L2/POS-PHY L3 or
SPI-3 for HDLC packets or mixed packet/cell traffic
Supports the following transmission protocols:
Direct-mapped ATM over DS3 or sub-rate DS3
PLCP-mapped ATM over DS3
Direct-mapped ATM over G.751 E3 or sub-rate G.751 E3
PLCP-mapped ATM over G.751 E3
Direct-mapped ATM over G.832 E3 or sub-rate G.832 E3
Bit or byte synchronous (octet aligned) direct-mapped ATM over externally-defined frame formats up to
52 Mbps
Clear-channel ATM (cell-based physical layer) at line rates up to 52 Mbps
Clear-channel ATM DSS at line rates up to 52 Mbps
Direct-mapped HDLC over DS3 or sub-rate DS3
Direct-mapped HDLC over G.751 E3 or sub-rate G.751 E3
Direct-mapped HDLC over G.832 E3 or sub-rate G.832 E3
Bit or byte synchronous (octet aligned) direct-mapped HDLC over externally-defined frame formats up
to 52 Mbps
Clear-channel HDLC at line rates up to 52 Mbps
In UTOPIA bus mode, ports are independently configurable for any ATM protocol
In POS-PHY bus mode, ports are independently configurable for any ATM or HDLC protocol
Programmable to support internally or externally controlled sub-rate DS3 or E3 on any ports
Supports gapped 52 MHz clock rates for signals embedded in SONET/SDH
Optional transmit loop timed clock(s) mode using the associated port’s receive clock(s)
Optional transmit clock mode using references generated by the internal Clock Rate Adapter (CLAD)
Requires only a single reference clock for all three LIU data rates using internal CLAD
The LIU can be powered down and bypassed for direct logic IO to/from line circuits.
Jitter attenuator can be placed in either transmit or receive path when the LIU is enabled.
Clock, data and control signals can be inverted for a direct interface to many other devices
Detection of loss of transmit clock and loss of receive clock
Automatic one-second, external or manual update of performance monitoring counters
Each port can be placed into a low-power standby mode when not being used
Framing and line code error insertion available
3.2 Receive DS3/E3/STS-1 LIU Features
AGC/Equalizer block handles from 0 dB to 15 dB of cable loss
Loss-of-lock PLL status indication
Interfaces directly to a DSX monitor signal (20 dB flat loss) using built-in pre-amp
Digital and analog Loss of Signal (LOS) detectors (ANSI T1.231 and ITU G.775)
Per-channel power-down control
3.3 Receive DS3/E3 Framer Features
Frame synchronization for M23 or C-bit Parity DS3, or G.751 E3 or G.832 E3
B3ZS/HDB3/AMI decoding
Detection and accumulation of bipolar violations (BPV), code violations (CV), excessive zeroes occurrences
(EXZ), F-bit errors, M-bit errors, FAS errors, LOF occurrences, P-bit parity errors, CP-bit parity errors, BIP-8
errors, and far end block errors (FEBE)
相關(guān)PDF資料
PDF描述
DS3163 IC TRPL ATM/PACKET PHY 400-PBGA
RSM43DRTF-S13 CONN EDGECARD 86POS .156 EXTEND
24AA02E48T-I/OT IC EEPROM 2KBIT 400KHZ SOT23-5
LFECP33E-3FN672I IC FPGA 32.8KLUTS 672FPBGA
LFECP33E-4FN672C IC FPGA 32.8KLUTS 672FPBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
DS3182+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3182N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3183 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Trpl ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3183N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Trpl ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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