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參數(shù)資料
| 型號(hào)： | DS3172 |
| 英文描述： | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| 中文描述： | 單/雙/三/四路、DS3/E3單芯片收發(fā)器 |
| 文件頁數(shù)： | 33/232頁 |
| 文件大?。?/td> | 2133K |
| 代理商： | DS3172 |
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DS3171/DS3172/DS3173/DS3174
33 of 230
PIN NAME
TYPE
PIN DESCRIPTION
the clock. The signal is typically referenced to the RCLKOn receive clock output pin,
but it can be referenced to the RLCLKn clock input pin.
This signal can be inverted.
RDENn
: When the port framer is configured for the DS3 or E3 framed modes and the
RDENn pin function is enabled, this signal is used to indicate the DS3/E3 payload bit
positions of the data on the RSERn pin. The signal goes high during each DS3/E3
payload bit and goes low during each DS3/E3 overhead bit. The signal is updated on
the positive clock edge of the referenced clock pin if the clock pin signal is not
inverted, otherwise it is updated on the falling edge of the clock. The signal is typically
referenced to the RCLKOn receive clock output pin, but it can be referenced to the
RLCLKn clock input pin.
This signal can be inverted.
Microprocessor Interface
Bi-directional 16 or 8-bit data bus
This bus is tri-state when
RST
pin is low or
CS
pin is high.
D[15:0]
: A 16-bit or 8-bit data bus used to input data during register writes, and data
outputs during register reads. The upper 8 bits are not used and never driven in 8-bit
bus mode.
Weak pull up resistors or bus holders should be used for each pin.
Address bus (minus LSB)
A[10:1]
: identifies the specific 16 bit registers, or group of 8 bit registers, being
accessed. A[10] must be tied to ground for the DS3181 and DS3182 versions.
Address bus LSB / Byte Swap
A[0]
: This signal is connected to the lower address bit in 8-bit systems. (WIDTH=0)
1 = Output register bits 15:8 on D[7:0], D[15:8] not driven
0 = Output register bits 7:0 on D[7:0], D[15:8] not driven
BSWAP
: This signal is tied high or low in 16-bit systems.
(WIDTH=1)
1 = Output register bits 15:8 on D[7:0], 7:0 on D[15:8]
0 = Output register bits 7:0 on D[7:0], 15:8 on D[15:8]
Address Latch Enable
ALE
: This signal is used to latch the address on the A[10:0] pins in multiplexed
address systems. When it is high the address is fed through the address latch to the
internal logic. When it transitions to low, the address is latched and held internally
until the signal goes back high. ALE should be tied high for non-multiplexed address
systems.
Chip Select (active low)
CS
: This signal must be low during all accesses to the registers
Read Strobe (active low) / Data Strobe (active low)
RD
: Read Strobe mode (MODE=0):
RD
is low during a register read.
DS
: Data Strobe mode (MODE=1):
DS
is low during either a register read or a write.
Write Strobe (active low) / R/W Select
WR
: Write Strobe mode (MODE=0):
WR
is low during a register write.
R/
W
: Data Strobe mode (MODE=1):
R/
W
is high during a register read cycle, and low during a register write cycle.
Ready handshake (active low)
RDY
: This ready signal is driven low when the current read or write cycle is in
progress. When the current read or write cycle is not ready it is driven high. When
device is not selected, it is not driven.
Interrupt (active low)
This signal is tri-state when
RST
pin is low.
D[15:0]
IO
A[10:1]
I
A[0] /
BSWAP
ALE
I
CS
I
RD
/
DS
I
WR
/
R/
W
I
RDY
Oz
INT
Oz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3172N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3173 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3173N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3174 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3174N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
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參數(shù)描述 |
|---|---|
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| DS3172N | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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