參數(shù)資料
型號： DS26518GN
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 數(shù)字傳輸電路
英文描述： 8-Port T1/E1/J1 Transceiver
中文描述： DATACOM, FRAMER, PBGA256
封裝： 17 X 17 MM, 1 MM, PITCH, TECSBGA-256
文件頁數(shù)： 133/286頁
文件大?。?/td> 1539K
代理商： DS26518GN
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DS26518 8-Port T1/E1/J1 Transceiver
133 of 286
10.4 Framer Register Descriptions
10.4.1 Receive Register Descriptions
See
Table 10-3
for the complete framer register list.
Register Name:
RHC
Register Description:
Receive HDLC Control Register
Register Address:
010h + (200h x (n - 1)) : where n = 1 to 8
Bit #
7
6
Name
RCRCD
RHR
Default
0
0
Bit 7: Receive CRC-16 Display (RCRCD)
0 = Do not write received CRC-16 code to FIFO (default).
1 = Write received CRC-16 code to FIFO after last octet of packet.
Bit 6: Receive HDLC Reset (RHR).
Will reset the receive HDLC controller and flush the receive FIFO. Note that
this bit is a acknowledged reset. The host should set this bit and the DS26518 will clear it once the reset operation
is complete. The DS26518 will complete the HDLC reset within 2 frames.
0 = Normal operation.
1 = Reset receive HDLC controller and flush the receive FIFO.
Bit 5: Receive HDLC Mapping Select (RHMS)
0 = Receive HDLC assigned to channels.
1 = Receive HDLC assigned to FDL (T1 mode), Sa bits (E1 mode).
Bits 4 to 0: Receive HDLC Channel Select 4 to 0 (RHCS[4:0]).
These bits determine which DS0 is mapped to
the HDLC controller when enabled with RHMS = 0. RHCS[4:0] = all 0s selects channel 1, RHCS[4:0] = all 1s
selects channel 32 (E1). A change to the receive HDLC channel select is acknowledged only after a receive HDLC
reset (RHR).
5
4
3
2
1
0
RHMS
0
RHCS4
0
RHCS3
0
RHCS2
0
RHCS1
0
RHCS0
0
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