參數(shù)資料
型號： DS26303LN-120+
廠商： Maxim Integrated Products
文件頁數(shù)： 21/101頁
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描述： IC LIU E1/T1/J1 3.3V 144-ELQFP
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 13
類型： 線路接口裝置（LIU）
驅(qū)動器/接收器數(shù)： 8/8
規(guī)程： T1/E1/J1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP 裸露焊盤
供應商設備封裝： 144-LQFP 裸露焊盤
包裝： 托盤
產(chǎn)品目錄頁面： 1430 (CN2011-ZH PDF)
DS26303: 3.3V, T1/E1/J1, Short-Haul, Octal Line Interface Unit
26 of 101
Table 5-4. BERT Register Set
ADDRESS
REGISTER
NAME
HEX
PARALLEL
INTERFACE
A7–A0 (HEX)
SERIAL
INTERFACE
A7–A1 (HEX)
RW
BERT Control
00
xxx00000
xx00000
RW
Reserved
—
01
xxx00001
xx00001
BERT Pattern Configuration 1
02
xxx00010
xx00010
RW
BERT Pattern Configuration 2
03
xxx00011
xx00011
RW
BERT Seed/Pattern 1
04
xxx00100
xx00100
RW
BERT Seed/Pattern 2
05
xxx00101
xx00101
RW
BERT Seed/Pattern 3
06
xxx00110
xx00110
RW
BERT Seed/Pattern 4
07
xxx00111
xx00111
RW
Transmit Error-Insertion Control
08
xxx01000
xx01000
RW
Reserved
—
09–0B
xxx01001–
xxx01010
xx01001–
xx01010—
—
BERT Status
0C
xxx01100
xx01100
R
Reserved
—
0D
xxx01101
xx01101
—
BERT Status Register Latched
0E
xxx01110
xx01110
RW
Reserved
—
0F
xxx01111
xx01111
—
BERT Status Register Interrupt Enable
10
xxx10000
xx10000
RW
Reserved
—
11–13
xxx10001–
xxx10011
xx10001–
xx10011
—
Receive Bit-Error Count Register 1
14
xxx10100
xx10100
R
Receive Bit-Error Count Register 2
15
xxx10101
xx10101
R
Receive Bit-Error Count Register 3
16
xxx10110
xx10110
R
Reserved
—
17
xxx10111
xx10111
—
Receive Bit Count Register 1
18
xxx11000
xx11000
R
Receive Bit Count Register 2
19
xxx11001
xx11001
R
Receive Bit Count Register 3
1A
xxx11010
xx11010
R
Receive Bit Count Register 4
1B
xxx11011
xx11011
R
Reserved
—
1C–1E
xxx11100–
xxx11110
xx11100–
xx11110
—
Address Pointer for Bank Selection
1F
xxx11111
xx11111
RW
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PDF描述
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