參數(shù)資料
型號： DS21Q55N
廠商： Electronic Theatre Controls, Inc.
英文描述： Quad T1/E1/J1 Transceiver
中文描述： 四路T1/E1/J1收發(fā)器
文件頁數(shù)： 40/237頁
文件大小： 1438K
代理商： DS21Q55N
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DS21Q55 Quad T1/E1/J1 Transceiver
40 of 237
ADDRESS
REGISTER NAME
REGISTER
ABBREVIATION
H2RCS3
H2RCS4
H2RTSBS
H2TCS1
H2TCS2
H2TCS3
H2TCS4
H2TTSBS
H2RPBA
H2TF
H2RF
H2TFBA
ESIBCR1
ESIBCR2
ESIB1
ESIB2
ESIB3
ESIB4
IBCC
TCD1
TCD2
RUPCD1
RUPCD2
RDNCD1
RDNCD2
RSCC
RSCD1
RSCD2
RFDL
TFDL
RFDLM1
RFDLM2
TEST
IBOC
RAF
RNAF
RSiAF
RSiNAF
RRA
RSa4
RSa5
RSa6
RSa7
RSa8
PAGE
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CA
CB
CC
CD
CE
CF
HDLC #2 Receive Channel Select 3
HDLC #2 Receive Channel Select 4
HDLC #2 Receive Time Slot Bits/Sa Bits Select
HDLC #2 Transmit Channel Select 1
HDLC #2 Transmit Channel Select 2
HDLC #2 Transmit Channel Select 3
HDLC #2 Transmit Channel Select 4
HDLC #2 Transmit Time Slot Bits/Sa Bits Select
HDLC #2 Receive Packet Bytes Available
HDLC #2 Transmit FIFO
HDLC #2 Receive FIFO
HDLC #2 Transmit FIFO Buffer Available
Extend System Information Bus Control Register 1
Extend System Information Bus Control Register 2
Extend System Information Bus Register 1
Extend System Information Bus Register 2
Extend System Information Bus Register 3
Extend System Information Bus Register 4
In-Band Code Control Register
Transmit Code Definition Register 1
Transmit Code Definition Register 2
Receive Up Code Definition Register 1
Receive Up Code Definition Register 2
Receive Down Code Definition Register 1
Receive Down Code Definition Register 2
In-Band Receive Spare Control Register
Receive Spare Code Definition Register 1
Receive Spare Code Definition Register 2
Receive FDL Register
Transmit FDL Register
Receive FDL Match Register 1
Receive FDL Match Register 2
Test Register
Interleave Bus Operation Control Register
Receive Align Frame Register
Receive Nonalign Frame Register
Receive Si Align Frame
Receive Si Nonalign Frame
Receive Remote Alarm Bits
Receive Sa4 Bits
Receive Sa5 Bits
Receive Sa6 Bits
Receive Sa7 Bits
Receive Sa8 Bits
135
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