參數(shù)資料
型號： DS21552LN+
廠商： Maxim Integrated Products
文件頁數(shù)： 7/137頁
文件大?。?/td> 0K
描述： IC TXRX T1 1-CHIP 5V 100-LQFP
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 90
功能： 單芯片收發(fā)器
接口： E1，HDLC，J1，T1
電路數(shù)： 1
電源電壓： 4.75 V ~ 5.25 V
電流 - 電源： 75mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
包括： DSX-1 和 CSU 線路補償發(fā)生器，HDLC 控制器，帶內(nèi)回路代碼發(fā)生器和檢測器
DS21352/DS21552
104 of 137
IDENTIFICATION REGISTER
The identification register contains a 32-bit shift register and a 32-bit latched parallel output. This
register is selected during the IDCODE instruction and when the TAP controller is in the Test-Logic-
Reset state. See Table 19-2. Table 19-3 lists the device ID codes for the SCT devices.
Table 19-4 BOUNDARY SCAN CONTROL BITS
BIT
PIN
SYMBOL
TYPE
CONTROL BIT DESCRIPTION
2
1
RCHBLK
O
2JTMS
I
13
8MCLK
O
4JTCLK
I
5JTRST
I
06
RCL
O
7JTDI
I
8N/C
–
9N/C
–
10
JTDO
O
72
11
BTS
I
71
12
LIUC
I
70
13
8XCLK
O
69
14
TEST
I
68
15
NC
–
16
RTIP
I
17
RRING
I
18
RVDD
–
19
RVSS
–
20
RVSS
–
21
MCLK
I
22
XTALD
O
67
23
NC
–
24
RVSS
–
66
25
INT
O
26
N/C
–
27
N/C
–
28
N/C
–
29
TTIP
O
30
TVSS
–
31
TVDD
–
32
TRING
O
65
33
TCHBLK
O
64
34
TLCLK
O
63
35
TLINK
I
62
36
CI
I
61
–
TSYNC.cntl
–
0 = TSYNC an input
1 = TSYNC an output
60
37
TSYNC
I/O
Table 19-4 BOUNDARY SCAN CONTROL BITS (cont.)
BIT
PIN
SYMBOL
TYPE
CONTROL BIT DESCRIPTION
59
38
TPOSI
I
58
39
TNEGI
I
57
40
TCLKI
I
56
41
TCLKO
O
55
42
TNEGO
O
54
43
TPOSO
O
44
DVDD
–
相關(guān)PDF資料
PDF描述
DS2174Q+T&R IC BERT ENHANCED 44-PLCC
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參數(shù)描述
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DS21554GN 功能描述:IC TXRX E1 1-CHIP 5V 100-BGA RoHS:否 類別:集成電路 (IC) >> 接口 - 電信 系列:- 產(chǎn)品培訓模塊:Lead (SnPb) Finish for COTS 產(chǎn)品變化通告:Product Discontinuation 06/Feb/2012 標準包裝:750 系列:*
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