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參數資料
| 型號： | DS21552LN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數： | 16/137頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX T1 1-CHIP 5V 100-LQFP |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，HDLC，J1，T1 |
| 電路數： | 1 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | DSX-1 和 CSU 線路補償發(fā)生器，HDLC 控制器，帶內回路代碼發(fā)生器和檢測器 |
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DS21352/DS21552
112 of 137
Figure 21-5 RECEIVE SIDE 2.048 MHz BOUNDARY TIMING (with elastic store
enabled)
Notes:
1. RSER data in channels 1, 5, 9, 13, 17, 21, 25, and 29 are forced to one
2. RSYNC is in the output mode (RCR2.3 = 0)
3. RSYNC is in the input mode (RCR2.3 = 1)
4. RCHBLK is forced to one in the same channels as RSER (see Note 1)
5. The F-Bit position is passed through the receive side elastic store
RSER
CHANNEL 1
RCHCLK
RCHBLK
RSYSCLK
RSYNC
CHANNEL 31
CHANNEL 32
1
3
4
RSYNC2
RMSYNC
RSIG
CHANNEL 31
CHANNEL 32
B
A
C/A D/B
AB
CHANNEL 1
LSB MSB
LSB
F
5
相關PDF資料 |
PDF描述 |
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參數描述 |
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