參數(shù)資料
型號(hào)： DS21458
英文描述： Quad T1/E1/J1 Transceivers
中文描述： 四路T1/E1/J1收發(fā)器
文件頁(yè)數(shù)： 5/270頁(yè)
文件大?。?/td> 1652K
代理商： DS21458
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DS21455/DS21458 Quad T1/E1/J1 Transceivers
5 of 270
24.5.1
24.5.2
24.6
D4/SLC–96 O
PERATION
................................................................................................. 157
25.
LINE INTERFACE UNIT (LIU)....................................................................................................................158
25.1
LIU O
PERATION
.............................................................................................................. 159
25.2
LIU R
ECEIVER
................................................................................................................ 159
25.2.1
Receive Level Indicator
................................................................................................160
25.2.2
Receive G.703 Section 10 Synchronization Signal
.................................................160
25.2.3
Monitor Mode
.................................................................................................................160
25.3
LIU T
RANSMITTER
........................................................................................................... 161
25.3.1
Transmit Short-Circuit Detector/Limiter
.....................................................................161
25.3.2
Transmit Open-Circuit Detector
..................................................................................161
25.3.3
Transmit BPV Error Insertion
......................................................................................162
25.3.4
Transmit G.703 Section 10 Synchronization Signal (E1 Mode)
.............................162
25.4
MCLK P
RESCALER
......................................................................................................... 162
25.5
J
ITTER
A
TTENUATOR
....................................................................................................... 162
25.6
CMI (C
ODE
M
ARK
I
NVERSION
) O
PTION
............................................................................ 163
25.7
LIU C
ONTROL
R
EGISTERS
............................................................................................... 164
25.8
R
ECOMMENDED
C
IRCUITS
................................................................................................ 173
25.9
C
OMPONENT
S
PECIFICATIONS
.......................................................................................... 175
26.
PROGRAMMABLE IN-BAND LOOP CODE GENERATION AND DETECTION......................................179
27.
BERT FUNCTION.......................................................................................................................................186
27.1
BERT R
EGISTER
D
ESCRIPTION
....................................................................................... 187
27.2
BERT R
EPETITIVE
P
ATTERN
S
ET
..................................................................................... 192
27.3
BERT B
IT
C
OUNTER
....................................................................................................... 193
27.4
BERT E
RROR
C
OUNTER
................................................................................................. 194
28.
PAYLOAD ERROR INSERTION FUNCTION ............................................................................................195
28.1
N
UMBER
O
F
E
RROR
R
EGISTERS
...................................................................................... 197
28.1.1
Number Of Errors Left Register
..................................................................................198
29.
INTERLEAVED PCM BUS OPERATION...................................................................................................199
29.1
C
HANNEL
I
NTERLEAVE
M
ODE
........................................................................................... 199
29.2
F
RAME
I
NTERLEAVE
M
ODE
............................................................................................... 199
30.
EXTENDED SYSTEM INFORMATION BUS (ESIB)..................................................................................202
31.
PROGRAMMABLE BACKPLANE CLOCK SYNTHESIZER.....................................................................208
32.
FRACTIONAL T1/E1 SUPPORT................................................................................................................209
33.
USER-PROGRAMMABLE OUTPUT PINS ................................................................................................210
34.
TRANSMIT FLOW DIAGRAMS..................................................................................................................211
35.
JTAG-BOUNDARY-SCAN ARCHITECTURE AND TEST-ACCESS PORT .............................................216
35.1
I
NSTRUCTION
R
EGISTER
.................................................................................................. 220
35.2
T
EST
R
EGISTERS
............................................................................................................. 222
35.3
B
OUNDARY
S
CAN
R
EGISTER
............................................................................................ 222
35.4
B
YPASS
R
EGISTER
.......................................................................................................... 222
35.5
I
DENTIFICATION
R
EGISTER
............................................................................................... 222
36.
FUNCTIONAL TIMING DIAGRAMS...........................................................................................................228
36.1
T1 M
ODE
........................................................................................................................ 228
36.2
E1 M
ODE
........................................................................................................................ 238
37.
OPERATING PARAMETERS.....................................................................................................................251
38.
AC TIMING PARAMETERS AND DIAGRAMS..........................................................................................253
38.1
M
ULTIPLEXED
B
US
AC C
HARACTERISTICS
........................................................................ 253
38.2
N
ONMULTIPLEXED
B
US
AC C
HARACTERISTICS
................................................................. 256
38.3
R
ECEIVE
S
IDE
AC C
HARACTERISTICS
.............................................................................. 259
38.4
T
RANSMIT
AC C
HARACTERISTICS
.................................................................................... 265
39.
PACKAGE INFORMATION........................................................................................................................269
Receive Section
............................................................................................................155
Transmit Section
...........................................................................................................157
相關(guān)PDF資料
PDF描述
DS21458N Quad T1/E1/J1 Transceivers
DS2148 5V E1/T1/J1 Line Interface
DS2148G 5V E1/T1/J1 Line Interface
DS2148GN 5V E1/T1/J1 Line Interface
DS2148T 5V E1/T1/J1 Line Interface
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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DS21458DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 DS21458 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評(píng)估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS21458LDK 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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