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參數(shù)資料
| 型號(hào)： | CYD04S72V-133BBI |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | FLEx72 3.3V 64K/128K/256K x 72 Synchronous Dual-Port RAM |
| 中文描述： | 64K X 72 DUAL-PORT SRAM, 4.4 ns, PBGA484 |
| 封裝： | 23 X 23 MM, 1.60 MM HEIGHT, 1 MM PITCH, MO-192, FBGA-484 |
| 文件頁數(shù)： | 19/26頁 |
| 文件大?。?/td> | 470K |
| 代理商： | CYD04S72V-133BBI |
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PRELIMINARY
CYD04S72V
CYD09S72V
CYD18S72V
Document #: 38-06069 Rev. *D
Page 19 of 26
Counter Reset
[38, 39]
Notes:
38. CE
= BE0 – BE7= LOW; CE
= MRST = CNT/MSK = HIGH.
39. No dead cycle exists during counter reset. A Read or Write cycle may be coincidental with the counter reset.
Switching Waveforms
(continued)
CLK
ADDRESS
INTERNAL
ADDRESS
CNTEN
ADS
DATA
IN
CNTRST
R/W
DATA
OUT
A
n
A
m
A
p
A
x
0
1
A
n
A
m
A
p
Q
1
Q
n
Q
0
D
0
t
CH2
t
CL2
t
CYC2
t
SA
t
HA
t
SW
t
HW
t
SRST
t
HRST
t
SD
t
HD
t
CD2
t
CD2
t
CKLZ
[51]
RESET
ADDRESS 0
COUNTER
WRITE
READ
ADDRESS 0
ADDRESS 1
READ
READ
ADDRESS A
n
ADDRESS A
m
READ
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