參數(shù)資料
型號(hào)： CY8C20334
廠商： Cypress Semiconductor Corp.
英文描述： PSoC Mixed-Signal Array(PSoC混合信號(hào)陣列)
中文描述： PSoC混合信號(hào)陣列（的PSoC混合信號(hào)陣列）
文件頁(yè)數(shù)： 7/32頁(yè)
文件大?。?/td> 378K
代理商： CY8C20334
September 18, 2006
Document No. 001-05356 Rev. *B
7
1.
Pin Information
This chapter describes, lists, and illustrates the CY8C20234, CY8C20334 and CY8C20434 PSoC device pins and pinout configura-
tions.
1.1
Pinouts
The CY8C20x34 PSoC device is available in a variety of packages which are listed and illustrated in the following tables. Every port
pin (labeled with a “P”) is capable of Digital IO and connection to the common analog bus. However, Vss, Vdd, and XRES are not
capable of Digital IO.
1.1.1
16-Pin Part Pinout
Table 1-1. 16-Pin Part Pinout (QFN**)
Pin
No.
Type
Name
Description
CY8C20234 16-Pin PSoC Device
Digital
IO
IO
IOH
IOH
IOH
IOH
Analog
I
I
I
I
I
I
1
2
3
4
5
6
7
8
9
10
11
P2[5]
P2[1]
P1[7]
P1[5]
P1[3]
P1[1]
Vss
P1[0]
P1[2]
P1[4]
XRES
I2C SCL, SPI SS.
I2C SDA, SPI MISO.
SPI CLK.
CLK*, I2C SCL, SPI MOSI.
Ground connection.
DATA*, I2C SDA.
Power
IOH
IOH
IOH
I
I
I
Optional external clock input (EXTCLK).
Active high external reset with internal
pull down.
Input
12
13
14
15
16
CP
IO
I
P0[4]
Vdd
P0[7]
P0[3]
P0[1]
Vss
Power
Supply voltage.
IO
IO
IO
I
I
I
Integrating input.
Power
Center pad must be connected to
ground.
LEGEND
A = Analog, I = Input, O = Output, OH = 5 mA High Output Drive.
* These are the ISSP pins, which are not High Z at POR (Power On Reset).
** The center pad (CP) on the QFN package should be connected to ground (Vss) for best mechanical, thermal, and electrical performance. If not connected to ground,
it should be electrically floated and not connected to any other signal.
QFN
(Top View)
CP
AI, P2[5]
AI, P2[1]
AI, I2C SCL, SPI SS, P1[7]
AI, I2C SDA, SPI MISO, P1[5]
A
1
2
3
4
5
11
10
9
1
1
1
1
12
P
P
V
P0[4], AI
XRES
C
A
P1[2], AI
P1[4], AI, EXTCLK
P
V
6
7
8
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PDF描述
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CY8C22113 PSoC Mixed Signal Array
CY8C22113-24PI PSoC Mixed Signal Array
CY8C22113-24SI PSoC Mixed Signal Array
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