參數(shù)資料
型號： CY7C68014A-100AXC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： 微控制器/微處理器
英文描述： Light Pipe; Mounting Hole Dia:3.5mm; Material:Polycarbonate; Length:10.2mm; Color:Clear; Leaded Process Compatible:Yes; Peak Reflow Compatible (260 C):Yes RoHS Compliant: Yes
中文描述： 8-BIT, EEPROM, 48 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, 1.40 MM HEIGHT, LEAD FREE, PLASTIC, MS-026, TQFP-100
文件頁數(shù)： 40/55頁
文件大?。?/td> 1958K
代理商： CY7C68014A-100AXC
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
Document #: 38-08032 Rev. *G
Page 40 of 55
9.6
Slave FIFO Synchronous Read
IFCLK
SLRD
FLAGS
SLOE
t
SRD
t
RDH
t
OEon
t
XFD
t
XFLG
DATA
t
IFCLK
N+1
t
OEoff
N
Figure 9-5. Slave FIFO Synchronous Read Timing Diagram
[19]
Table 9-6. Slave FIFO Synchronous Read Parameters with Internally Sourced IFCLK
[21]
Parameter
t
IFCLK
t
SRD
t
RDH
t
OEon
t
OEoff
t
XFLG
t
XFD
Description
Min.
20.83
18.7
0
Max.
Unit
ns
ns
ns
ns
ns
ns
ns
IFCLK Period
SLRD to Clock Set-up Time
Clock to SLRD Hold Time
SLOE Turn-on to FIFO Data Valid
SLOE Turn-off to FIFO Data Hold
Clock to FLAGS Output Propagation Delay
Clock to FIFO Data Output Propagation Delay
10.5
10.5
9.5
11
TBD
Table 9-7. Slave FIFO Synchronous Read Parameters with Externally Sourced IFCLK
[21]
Parameter
t
IFCLK
t
SRD
t
RDH
t
OEon
t
OEoff
t
XFLG
t
XFD
Description
Min.
20.83
12.7
3.7
Max.
200
Unit
ns
ns
ns
ns
ns
ns
ns
IFCLK Period
SLRD to Clock Set-up Time
Clock to SLRD Hold Time
SLOE Turn-on to FIFO Data Valid
SLOE Turn-off to FIFO Data Hold
Clock to FLAGS Output Propagation Delay
Clock to FIFO Data Output Propagation Delay
10.5
10.5
13.5
15
TBD
相關PDF資料
PDF描述
CY7C68014A-128AXC Light Pipe; Mounting Hole Dia:3.5mm; Material:Polycarbonate; Length:11.4mm; Color:Clear; Leaded Process Compatible:Yes; Peak Reflow Compatible (260 C):Yes RoHS Compliant: Yes
CY7C68014A EZ-USB FX2LP USB Microcontroller
CY7C68014A-56LFXC D-SSK 110 KER
CY7C68014A-56PVXC EZ-USB FX2LP USB Microcontroller
CY7C68015A-56LFXC EZ-USB FX2LP USB Microcontroller
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