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參數(shù)資料
| 型號(hào)： | CY7C374I-66AC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類(lèi)： | PLD |
| 英文描述： | UltraLogic 128-Macrocell Flash CPLD |
| 中文描述： | FLASH PLD, 20 ns, PQFP100 |
| 封裝： | PLASTIC, TQFP-100 |
| 文件頁(yè)數(shù)： | 8/13頁(yè) |
| 文件大?。?/td> | 274K |
| 代理商： | CY7C374I-66AC |
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CY7C374i
8
Reset/Preset Parameters
t
RW
t
RR
t
RO
t
PW
t
PR
t
PO
Tap Controller Parameter
f
TAP
Tap Controller Frequency
3.3V I/O Mode Parameters
t
3.3IO
3.3V I/O mode timing adder
Asynchronous Reset Width
[9]
Asynchronous Reset Recovery Time
[9]
Asynchronous Reset to Output
[1]
Asynchronous Preset Width
[9]
Asynchronous Preset Recovery Time
[9]
Asynchronous Preset to Output
[1]
10
12
12
14
15
17
20
22
ns
ns
ns
ns
ns
ns
16
18
21
26
10
12
12
14
15
17
20
22
16
18
21
26
500
500
500
500
kHz
1
1
1
1
ns
Switching Characteristics
Over the Operating Range
[14]
(continued)
7C374i–125
Min.
7C374i–100
Min.
7C374i–83
Min.
7C374i–66
7C374iL–66
Min.
Parameter
Description
Max.
Max.
Max.
Max.
Unit
Switching Waveforms
Combinatorial Output
t
PD
7C374i-7
INPUT
COMBINATORIAL
OUTPUT
Registered Output
t
S
7C374i-8
INPUT
CLOCK
t
CO
REGISTERED
OUTPUT
t
H
CLOCK
t
WL
t
WH
Latched Output
t
S
7C374i-9
INPUT
LATCH ENABLE
t
CO
LATCHED
OUTPUT
t
H
t
PDL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY7C374I-66AI | UltraLogic 128-Macrocell Flash CPLD |
| CY7C374I-66GMB | UltraLogic 128-Macrocell Flash CPLD |
| CY7C374I-83AC | UltraLogic 128-Macrocell Flash CPLD |
| CY7C374I-83AI | UltraLogic 128-Macrocell Flash CPLD |
| CY7C374I-83GMB | UltraLogic 128-Macrocell Flash CPLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY7C374I83AC | 制造商:Cypress Semiconductor 功能描述: |
| CY7C374I-83AC | 制造商:Cypress Semiconductor 功能描述:CPLD FLASH370i Family 3.2K Gates 128 Macro Cells 5V 100-Pin TQFP |
| CY7C374I-83JC | 制造商:Cypress Semiconductor 功能描述:CPLD FLASH370i Family 3.2K Gates 128 Macro Cells CMOS Technology 5V 84-Pin PLCC |
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