參數(shù)資料
型號(hào): CY7C1516AV18-300BZI
廠商: CYPRESS SEMICONDUCTOR CORP
元件分類: DRAM
英文描述: 72-Mbit DDR-II SRAM 2-Word Burst Architecture
中文描述: 8M X 8 DDR SRAM, 0.45 ns, PBGA165
封裝: 15 X 17 MM, 1.40 MM HEIGHT, MO-216, FBGA-165
文件頁(yè)數(shù): 24/28頁(yè)
文件大?。?/td> 1133K
代理商: CY7C1516AV18-300BZI
PRELIMINARY
CY7C1516AV18
CY7C1527AV18
CY7C1518AV18
CY7C1520AV18
Document #: 001-06982 Rev. *B
Page 24 of 28
Switching Waveforms
[29, 30, 31]
Notes:
29.Q00 refers to output from address A0. Q01 refers to output from the next internal burst address following A0, i.e., A0+1.
30.Outputs are disabled (High-Z) one clock cycle after a NOP.
31.In this example, if address A2 = A1,then data Q20 = D10 and Q21 = D11. Write data is forwarded immediately as read results. This note applies to the whole diagram.
READ
2
READ
8
READ
3
NOP
4
NOP
5
WRITE
7
WRITE
6
NOP
1
9
10
Q40
tKHCH
tCO
t
tHC
t
tHA
tSD
tHD
tKHCH
tSD
tHD
DON’T CARE
UNDEFINED
tCLZ
tDOH
tCHZ
SC
tKH
tKHKH
tKL
tCYC
A0
D20
D21
D30
D31
Q00
Q11
Q01
Q10
A1
A2
A3
A4
Q41
tCCQO
tCQOH
tCCQO
tCQOH
tKL
tCYC
K
K
LD
R/W
A
DQ
C
C#
CQ
CQ#
SA
tKH
tKHKH
t
CQD
t
CQDOH
tCQH
tCQHCQH
[+] Feedback
相關(guān)PDF資料
PDF描述
CY7C1516AV18-300BZXC 72-Mbit DDR-II SRAM 2-Word Burst Architecture
CY7C1516AV18-300BZXI 72-Mbit DDR-II SRAM 2-Word Burst Architecture
CY7C1518AV18 72-Mbit DDR-II SRAM 2-Word Burst Architecture
CY7C1518AV18-167BZC 72-Mbit DDR-II SRAM 2-Word Burst Architecture
CY7C1518AV18-167BZI 72-Mbit DDR-II SRAM 2-Word Burst Architecture
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參數(shù)描述
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