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參數(shù)資料
| 型號： | CY7C1383FV25 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 18-Mbit (512K x 36/1M x 18) Flow-Through SRAM |
| 中文描述： | 18兆位（為512k × 36/1M × 18）流通過的SRAM |
| 文件頁數(shù)： | 23/28頁 |
| 文件大?。?/td> | 952K |
| 代理商： | CY7C1383FV25 |
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CY7C1381DV25, CY7C1381FV25
CY7C1383DV25, CY7C1383FV25
Document #: 38-05547 Rev. *E
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ZZ Mode Timing
[29, 30]
Timing Diagrams
(continued)
tZZ
I
SUPPLY
CLK
ZZ
tZZREC
ALL INPUTS
(except ZZ)
DON’T CARE
IDDZZ
tZZI
tRZZI
Outputs (Q)
High-Z
DESELECT or READ Only
Notes
29.Device must be deselected when entering ZZ sleep mode. See Cycle Descriptions table for all possible signal conditions to deselect the device.
30.DQs are in high-Z when exiting ZZ sleep mode.
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PDF描述 |
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參數(shù)描述 |
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