參數(shù)資料
型號(hào): CY7C1383FV25
廠商: Cypress Semiconductor Corp.
英文描述: 18-Mbit (512K x 36/1M x 18) Flow-Through SRAM
中文描述: 18兆位(為512k × 36/1M × 18)流通過的SRAM
文件頁(yè)數(shù): 20/28頁(yè)
文件大小: 952K
代理商: CY7C1383FV25
CY7C1381DV25, CY7C1381FV25
CY7C1383DV25, CY7C1383FV25
Document #: 38-05547 Rev. *E
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Timing Diagrams
Read Cycle Timing
[25]
tCYC
tCL
CLK
tADH
tADS
ADDRESS
tCH
tAH
tAS
A1
tCEH
tCES
Data Out (Q)
High-Z
tCLZ
tDOH
tCDV
tOEHZ
tCDV
Single READ
BURST
READ
tOEV
tOELZ
tCHZ
Burst wraps around
to its initial state
tADVH
tADVS
tWEH
tWES
tADH
tADS
Q(A2)
Q(A2 + 1)
Q(A2 + 2)
Q(A1)
Q(A2)
Q(A2 + 1)
Q(A2 + 2)
Q(A2 + 3)
A2
ADV suspends burst
Deselect Cycle
DON’T CARE
UNDEFINED
ADSP
ADSC
GW, BWE,BW
X
CE
ADV
OE
Note
25.On this diagram, when CE is LOW: CE
1
is LOW, CE
2
is HIGH and CE
3
is LOW. When CE is HIGH: CE
1
is HIGH or CE
2
is LOW or CE
3
is HIGH.
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