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參數(shù)資料
| 型號： | CY7C09099 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 128K x 8 Synchronous Dual-Port Static RAM(128K x 8 同步雙端口靜態(tài)RAM) |
| 中文描述： | 128K的× 8同步雙端口靜態(tài)存儲器（128K的× 8同步雙端口靜態(tài)RAM）的 |
| 文件頁數(shù)： | 9/20頁 |
| 文件大?。?/td> | 337K |
| 代理商： | CY7C09099 |
CY7C09079/89/99
CY7C09179/89/99
9
PRELIMINARY
Switching Waveforms
Read Cycle for Flow-Through Output (FT/PIPE = V
IL
)
[14, 15, 16, 17]
Read Cycle for Pipelined Operation (FT/PIPE = V
IH
)
[14, 15, 16, 17]
Notes:
14. OE is asynchronously controlled; all other inputs are synchronous to the rising clock edge.
15. ADS = V
, CNTEN and CNTRST = V
.
16. The output is disabled (high-impedance state) by CE
=V
or CE
1
= V
following the next rising edge of the clock.
17. Addresses do not have to be accessed sequentially since ADS = V
IL
constantly loads the address on the rising edge of the CLK. Numbers are for reference only.
t
CH1
t
CL1
t
CYC1
t
SC
t
HC
t
DC
Q
n
t
OHZ
t
OE
t
SC
t
HC
t
SW
t
SA
t
HW
t
HA
t
CD1
t
CKHZ
t
DC
t
OLZ
t
CKLZ
A
n
A
n+1
A
n+2
A
n+3
Q
n+1
Q
n+2
CLK
CE
0
CE
1
R/W
ADDRESS
DATA
OUT
OE
t
CH2
t
CL2
t
CYC2
t
SC
t
HC
t
SW
t
SA
t
HW
t
HA
A
n
A
n+1
CLK
CE
0
CE
1
R/W
ADDRESS
DATA
OUT
OE
A
n+2
A
n+3
t
SC
t
HC
t
OHZ
t
OE
t
OLZ
t
DC
t
CD2
t
CKLZ
Q
n
Q
n+1
Q
n+2
1 Latency
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY7C09189 | 64K x 9 Synchronous Dual-Port Static RAM(64K x 9 同步雙端口靜態(tài)RAM) |
| CY7C09199 | 128K x 9 Synchronous Dual-Port Static RAM(128K x 9 同步雙端口靜態(tài)RAM) |
| CY7C09289A | 64K x16 Synchronous Dual Port Static RAM(64K x 16 同步雙端口靜態(tài) RAM) |
| CY7C09269A | 16K x16 Synchronous Dual Port Static RAM(16K x 16 同步雙端口靜態(tài) RAM) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| CY7C09099V-6AXC | 功能描述:靜態(tài)隨機(jī)存取存儲器 3.3V 128Kx8 COM Sync Dual Port 靜態(tài)隨機(jī)存取存儲器 RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
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