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參數資料
| 型號： | CY7C0851AV-167BBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | SRAM |
| 英文描述： | FLEx36™ 3.3V 32K/64K/128K/256K x 36 Synchronous Dual-Port RAM |
| 中文描述： | 64K X 36 DUAL-PORT SRAM, 4 ns, PBGA172 |
| 封裝： | 15 X 15 MM, 1.25 MM HEIGHT, 1 MM PITCH, FBGA-172 |
| 文件頁數： | 7/32頁 |
| 文件大?。?/td> | 971K |
| 代理商： | CY7C0851AV-167BBC |
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CY7C0850AV, CY7C0851AV
CY7C0852AV, CY7C0853AV
Document #: 38-06070 Rev. *H
Page 15 of 32
tOE
Output Enable to Data Valid
4.0
4.4
4.7
5.0
ns
tOLZ[20, 21]
OE to Low Z
0
ns
tOHZ[20, 21]
OE to High Z
0
4.00
4.404.7
05.0
ns
tCD2
Clock to Data Valid
4.0
4.4
4.7
5.0
ns
tCA2
Clock to Counter Address Valid
4.0
4.4
NA
ns
tCM2
Clock to Mask Register Readback Valid
4.0
4.4
NA
ns
tDC
Data Output Hold After Clock HIGH
1.0
ns
tCKHZ[20, 21] Clock HIGH to Output High Z
0
4.0
0
4.4
0
4.7
0
5.0
ns
tCKLZ[20, 21] Clock HIGH to Output Low Z
1.0
4.0
1.0
4.4
1.0
4.7
1.0
5.0
ns
tSINT
Clock to INT Set Time
0.5
6.7
0.5
7.5
0.5
7.5
0.5
10
ns
tRINT
Clock to INT Reset Time
0.5
6.7
0.5
7.5
0.5
7.5
0.5
10
ns
tSCINT
Clock to CNTINT Set Time
0.5
5.0
0.5
5.7
NA
ns
tRCINT
Clock to CNTINT Reset time
0.5
5.0
0.5
5.7
NA
ns
Port to Port Delays
tCCS
Clock to Clock Skew
5.2
6.0
8.0
ns
Master Reset Timing
tRS
Master Reset Pulse Width
7.0
7.5
10.0
ns
tRSS
Master Reset Setup Time
6.0
8.5
ns
tRSR
Master Reset Recovery Time
6.0
7.5
10.0
ns
tRSF
Master Reset to Outputs Inactive
10.0
ns
tRSCNTINT
Master Reset to Counter Interrupt Flag
Reset Time
10.0
NA
ns
Switching Characteristics
Over the Operating Range (continued)
Parameter
Description
-167
-133
-100
Unit
CY7C0850AV
CY7C0851AV
CY7C0852AV
CY7C0850AV
CY7C0851AV
CY7C0852AV
CY7C0853AV
Min
Max
Min
Max
Min
Max
Min
Max
Notes
20. This parameter is guaranteed by design, but it is not production tested.
21. Test conditions used are Load 2.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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| CY7C0851V-133AC | 制造商:Rochester Electronics LLC 功能描述:64K X 36 SYNC DPSRAM - Bulk 制造商:Cypress Semiconductor 功能描述: |
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| CY7C0851V-133BBC | 制造商:Rochester Electronics LLC 功能描述:64K X 36 SYNC DPSRAM - Bulk 制造商:Cypress Semiconductor 功能描述:SRAM Chip Sync Dual 3.3V 2.25M-Bit 64K x 36 4.4ns 172-Pin FBGA |
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