參數(shù)資料
型號(hào)： CY62128DV30L-70ZAI
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： DRAM
英文描述： 1 Mb (128K x 8) Static RAM
中文描述： 128K X 8 STANDARD SRAM, 70 ns, PDSO32
封裝： 8 X 13.40 MM, STSOP-32
文件頁(yè)數(shù)： 6/11頁(yè)
文件大?。?/td> 196K
代理商： CY62128DV30L-70ZAI
CY62128DV30
MoBL
Document #: 38-05231 Rev. *C
Page 6 of 11
Read Cycle No. 2 (OE Controlled)
[10, 13, 14]
Write Cycle No. 1 (WE Controlled)
[11,
15, 16, 17]
Notes:
14. Address valid prior to or coincident with CE
1
transition LOW and CE
2
transition HIGH.
15. Data I/O is high-impedance if OE = V
.
16. If CE
goes HIGH or CE
goes LOW simultaneously with WE HIGH, the output remains in a high-impedance state.
17. During the DON'T CARE period in the DATA I/O waveform, the I/Os are in output state and input signals should not be applied.
Switching Waveforms
(continued)
50%
50%
DATA VALID
t
RC
t
ACE
t
DOE
t
LZOE
t
LZCE
t
PU
HIGH IMPEDANCE
t
HZOE
t
HZCE
t
PD
HIGH
OE
CE
1
I
CC
I
SB
IMPEDANCE
ADDRESS
CE
2
DATA OUT
V
SUPPLY
CURRENT
t
WC
DATA VALID
t
AW
t
SA
t
PWE
t
HA
t
HD
t
SD
t
SCE
t
SCE
CE
1
ADDRESS
CE
2
WE
DATA I/O
相關(guān)PDF資料
PDF描述
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CY62128DV30LL-55ZAI 1 Mb (128K x 8) Static RAM
CY62128-55SC 128K x 8 Static RAM
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參數(shù)描述
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