參數(shù)資料
型號： CY37512
廠商： Cypress Semiconductor Corp.
英文描述： 5V, 3.3V, ISR High-Performance CPLDs(5V, 3.3V, ISR 高性能CPLD)
中文描述： 為5V，3.3V，ISR的高性能CPLD的（為5V，3.3V，ISR的高性能的CPLD）
文件頁數(shù)： 20/65頁
文件大小： 1184K
代理商： CY37512
Ultra37000
CPLD Family
[1]
20
Operating Frequency Parameters
f
MAX1
f
MAX2
Maximum Frequency with Internal Feedback (Lesser of 1/t
SCS
, 1/(t
S
+ t
H
), or 1/t
CO
)
[9]
Maximum Frequency Data Path in Output Registered/Latched Mode (Lesser of 1/(t
WL
+ t
WH
),
1/(t
S
+ t
H
), or 1/t
CO
)
[9]
Maximum Frequency with External Feedback (Lesser of 1/(t
CO
+ t
S
) or 1/(t
WL
+ t
WH
)
[9]
Maximum Frequency in Pipelined Mode (Lesser of 1/(t
CO
+ t
IS
), 1/t
ICS
, 1/(t
WL
+ t
WH
), 1/(t
IS
+ t
IH
),
or 1/t
SCS
)
[9]
Reset/Preset Parameters
Asynchronous Reset Width
[9]
t
RR[12]
t
RO[12, 13, 14]
Asynchronous Reset to Output
t
PW
t
PR[12]
t
PO[12, 13, 14]
Asynchronous Preset to Output
User Option Parameters
MHz
MHz
f
MAX3
f
MAX4
MHz
MHz
t
RW
ns
Asynchronous Reset Recovery Time
[9]
ns
ns
Asynchronous Preset Width
[9]
Asynchronous Preset Recovery Time
[9]
ns
ns
ns
t
LP
t
SLEW
t
3.3IO
JTAG Timing Parameters
t
S JTAG
t
H JTAG
t
CO
JTAG
f
JTAG
Low Power Adder
Slow Output Slew Rate Adder
3.3V I/O Mode Timing Adder
[9]
ns
ns
ns
Set-Up Time from TDI and TMS to TCK
[9]
Hold Time on TDI and TMS
[9]
ns
ns
Falling Edge of TCK to TDO[9]
Maximum JTAG Tap Controller Frequency
[9]
ns
ns
Switching Characteristics
Over the Operating Range
[11]
(continued)
Parameter
Description
Unit
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PDF描述
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