參數(shù)資料
型號： C8051T600EDB
廠商： Silicon Laboratories Inc
文件頁數(shù)： 49/188頁
文件大?。?/td> 0K
描述： BOARD DAUGHTER FOR C8051T600E
標準包裝： 1
附件類型： 子板
適用于相關(guān)產(chǎn)品： C8051T600
產(chǎn)品目錄頁面： 626 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： 336-1403-5-ND - IC 8051 MCU 8K OTP 14SOIC
336-1402-5-ND - IC 8051 MCU 8K OTP 11QFN
其它名稱： 336-1665
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C8051T600/1/2/3/4/5/6
142
Rev. 1.2
SFR Address = 0x98; Bit-Addressable
SFR Definition 24.1. SCON0: Serial Port 0 Control
Bit
76543210
Name
S0MODE
MCE0
REN0
TB80
RB80
TI0
RI0
Type
R/W
R
R/W
Reset
01000000
Bit
Name
Function
7S0MODE Serial Port 0 Operation Mode.
Selects the UART0 Operation Mode.
0: 8-bit UART with Variable Baud Rate.
1: 9-bit UART with Variable Baud Rate.
6
Unused
Unused. Read = 1b, Write = Don’t Care.
5MCE0
Multiprocessor Communication Enable.
The function of this bit is dependent on the Serial Port 0 Operation Mode:
Mode 0: Checks for valid stop bit.
0: Logic level of stop bit is ignored.
1: RI0 will only be activated if stop bit is logic level 1.
Mode 1: Multiprocessor Communications Enable.
0: Logic level of ninth bit is ignored.
1: RI0 is set and an interrupt is generated only when the ninth bit is logic 1.
4REN0
Receive Enable.
0: UART0 reception disabled.
1: UART0 reception enabled.
3TB80
Ninth Transmission Bit.
The logic level of this bit will be sent as the ninth transmission bit in 9-bit UART Mode
(Mode 1). Unused in 8-bit mode (Mode 0).
2RB80
Ninth Receive Bit.
RB80 is assigned the value of the STOP bit in Mode 0; it is assigned the value of the
9th data bit in Mode 1.
1TI0
Transmit Interrupt Flag.
Set by hardware when a byte of data has been transmitted by UART0 (after the 8th bit
in 8-bit UART Mode, or at the beginning of the STOP bit in 9-bit UART Mode). When
the UART0 interrupt is enabled, setting this bit causes the CPU to vector to the UART0
interrupt service routine. This bit must be cleared manually by software.
0RI0
Receive Interrupt Flag.
Set to 1 by hardware when a byte of data has been received by UART0 (set at the
STOP bit sampling time). When the UART0 interrupt is enabled, setting this bit to 1
causes the CPU to vector to the UART0 interrupt service routine. This bit must be
cleared manually by software.
相關(guān)PDF資料
PDF描述
ISL9000BJEV2 EVAL BOARD 1.5V/2.8V ISL9000BJ
EEM08DRSD-S664 CONN EDGECARD 16POS DIP .156 SLD
AK2524-R CABLE CD-ROM AUDIO 4POS-3WIRE
0210490329 CABLE JUMPER 1.25MM .127M 26POS
101A062-4-0 BOOT MOLDED
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參數(shù)描述
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