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參數(shù)資料
| 型號(hào)： | C8051T600EDB |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 48/188頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD DAUGHTER FOR C8051T600E |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 附件類型： | 子板 |
| 適用于相關(guān)產(chǎn)品： | C8051T600 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | 336-1403-5-ND - IC 8051 MCU 8K OTP 14SOIC 336-1402-5-ND - IC 8051 MCU 8K OTP 11QFN |
| 其它名稱： | 336-1665 |
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Rev. 1.2
141
C8051T600/1/2/3/4/5/6
24.3. Multiprocessor Communications
The 9-Bit UART mode supports multiprocessor communication between a master processor and one or
more slave processors by special use of the ninth data bit. When a master processor wants to transmit to
one or more slaves, it first sends an address byte to select the target(s). An address byte differs from a
data byte in that its ninth bit is logic 1; in a data byte, the ninth bit is always set to logic 0.
Setting the MCE0 bit (SCON0.5) of a slave processor configures its UART such that when a stop bit is
received, the UART will generate an interrupt only if the ninth bit is logic 1 (RB80 = 1) signifying an address
byte has been received. In the UART interrupt handler, software will compare the received address with
the slave's own assigned 8-bit address. If the addresses match, the slave will clear its MCE0 bit to enable
interrupts on the reception of the following data byte(s). Slaves that weren't addressed leave their MCE0
bits set and do not generate interrupts on the reception of the following data bytes, thereby ignoring the
data. Once the entire message is received, the addressed slave resets its MCE0 bit to ignore all transmis-
sions until it receives the next address byte.
Multiple addresses can be assigned to a single slave and/or a single address can be assigned to multiple
slaves, thereby enabling "broadcast" transmissions to more than one slave simultaneously. The master
processor can be configured to receive all transmissions or a protocol can be implemented such that the
master/slave role is temporarily reversed to enable half-duplex transmission between the original master
and slave(s).
Figure 24.6. UART Multi-Processor Mode Interconnect Diagram
Master
Device
Slave
Device
TX
RX
TX
Slave
Device
RX
TX
Slave
Device
RX
TX
V+
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ISL9000BJEV2 | EVAL BOARD 1.5V/2.8V ISL9000BJ |
| EEM08DRSD-S664 | CONN EDGECARD 16POS DIP .156 SLD |
| AK2524-R | CABLE CD-ROM AUDIO 4POS-3WIRE |
| 0210490329 | CABLE JUMPER 1.25MM .127M 26POS |
| 101A062-4-0 | BOOT MOLDED |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| C8051T600-EDB | 制造商:Silicon Laboratories Inc 功能描述:C8051T600 Evaluation Daughter Board 制造商:Silicon Laboratories Inc 功能描述:FLASH EMULATION DAUGHTER BOARD - Boxed Product (Development Kits) |
| C8051T600-EDB-K | 功能描述:FLASH EMULATION DAUGHTER BOARD 制造商:silicon labs 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1 |
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| C8051T600-GMR | 功能描述:8位微控制器 -MCU 8K OTP 25 MIPS 10bit 500ksps ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051T600-GS | 功能描述:8位微控制器 -MCU 8K OTP 25 MIPS 10bit 500ksps ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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