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參數(shù)資料
| 型號： | C8051F300DK |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Mixed Signal ISP Flash MCU Family |
| 中文描述： | 混合信號ISP的閃存微控制器系列 |
| 文件頁數(shù)： | 9/310頁 |
| 文件大?。?/td> | 2478K |
| 代理商： | C8051F300DK |
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2002 Cygnal Integrated Products, Inc.
DS007-0.4-NOV02
Page 9
C8051F060/1/2/3
A
DVANCD
Figure 5.18. ADC1 Data Word Example.................................................................................60
Figure 5.19. Calibration Coefficient Locations .......................................................................61
Figure 5.20. Offset and Gain Register Mapping......................................................................62
Figure 5.21. Offset and Gain Calibration Block Diagram.......................................................62
Advanced
Information
LIST OF FIGURES
Figure 1.1. C8051F060/2 Block Diagram..............................................................................21Figure 1.2. C8051F061/3 Block Diagram..............................................................................22
Figure 1.3. Comparison of Peak MCU Execution Speeds.....................................................23
Figure 1.4. On-Board Clock and Reset..................................................................................24
Figure 1.5. On-Chip Memory Map........................................................................................25
Figure 1.6. Development/In-System Debug Diagram ...........................................................26
Figure 1.7. Digital Crossbar Diagram....................................................................................27
Figure 1.8. PCA Block Diagram............................................................................................28
Figure 1.9. CAN Controller Overview ..................................................................................29
Figure 1.10. 16-Bit ADC Block Diagram................................................................................31
Figure 1.11. 10-Bit ADC Diagram ..........................................................................................32
Figure 1.12. Comparator and DAC Diagram...........................................................................33
2. ABSOLUTE MAXIMUM RATINGS..................................................................................34
3. GLOBAL DC ELECTRICAL CHARACTERISTICS......................................................35
4. PINOUT AND PACKAGE DEFINITIONS........................................................................36
Figure 4.1. TQFP-100 Pinout Diagram..................................................................................41
Figure 4.2. TQFP-100 Package Drawing...............................................................................42
Figure 4.3. TQFP-64 Pinout Diagram....................................................................................43
Figure 4.4. TQFP-64 Package Drawing.................................................................................44
5. 16-BIT ADCS (ADC0 AND ADC1)......................................................................................45
Figure 5.1. 16-Bit ADC0 and ADC1 Control Path Diagram.................................................45
Figure 5.2. 16-bit ADC0 and ADC1 Data Path Diagram......................................................46
Figure 5.3. Voltage Reference Block Diagram......................................................................47
Figure 5.4. ADC Track and Conversion Example Timing....................................................49
Figure 5.5. ADC0 and ADC1 Equivalent Input Circuits.......................................................51
Figure 5.6. AMX0SL: AMUX Configuration Register.........................................................52
Figure 5.7. ADC0CF: ADC0 Configuration Register ...........................................................53
Figure 5.8. ADC1CF: ADC1 Configuration Register ...........................................................54
Figure 5.9. ADC0CN: ADC0 Control Register.....................................................................55
Figure 5.10. ADC1CN: ADC1 Control Register.....................................................................56
Figure 5.11. REF0CN: Reference Control Register 0.............................................................57
Figure 5.12. REF1CN: Reference Control Register 1.............................................................57
Figure 5.14. ADC0L: ADC0 Data Word LSB Register..........................................................58
Figure 5.15. ADC0 Data Word Example.................................................................................59
Figure 5.16. ADC1H: ADC1 Data Word MSB Register.........................................................60
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PDF描述 |
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