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參數(shù)資料
| 型號： | BX80532KC2000D |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 2000 MHz, MICROPROCESSOR, CPGA603 |
| 封裝： | PGA-603 |
| 文件頁數(shù)： | 63/129頁 |
| 文件大?。?/td> | 1640K |
| 代理商： | BX80532KC2000D |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁當前第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁
Intel Xeon Processor with 512 KB L2 Cache
Datasheet
39
Figure 9. Front Side Bus Common Clock Valid Delay Timing Waveform
BCLK0
BCLK1
Common Clock
Signal (@ driver)
Common Clock
Signal (@ receiver)
T0
T1
T2
T
Q
T
R
valid
T
P
T
P = T10: Common Clock Output Valid Delay
T
Q = T11: Common Clock Input Setup
T
R = T12: Common Clock Input Hold Time
Figure 10. Front Side Bus Source Synchronous 2X (Address) Timing Waveform
T
J
BCLK0
BCLK1
ADSTB# (@ driver)
A# (@ driver)
A# (@ receiver)
ADSTB# (@ receiver)
T1
T2
1/4
BCLK
1/2
BCLK
3/4
BCLK
T
H
T
H
T
J
T
N
T
K
T
M
valid
T
H = T23: Source Sync. Address Output Valid Before Address Strobe
T
J = T24: Source Sync. Address Output Valid After Address Strobe
T
K = T27: Source Sync. Input Setup to BCLK
T
M = T26: Source Sync. Input Hold Time
T
N = T25: Source Sync. Input Setup Time
T
P = T28: First Address Strobe to Second Address Strobe
T
S = T20: Source Sync. Output Valid Delay
T
R = T31: Address Strobe Output Valid Delay
T
P
T
R
T
S
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