參數(shù)資料
型號(hào)： AX125-FGG256I
廠商： Microsemi SoC
文件頁(yè)數(shù)： 171/262頁(yè)
文件大?。?/td> 0K
描述： IC FPGA AXCELERATOR 125K 256FBGA
標(biāo)準(zhǔn)包裝： 90
系列： Axcelerator
邏輯元件/單元數(shù)： 1344
RAM 位總計(jì)： 18432
輸入/輸出數(shù)： 138
門數(shù)： 125000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)當(dāng)前第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)第254頁(yè)第255頁(yè)第256頁(yè)第257頁(yè)第258頁(yè)第259頁(yè)第260頁(yè)第261頁(yè)第262頁(yè)
Package Pin Assignments
3- 12 6
R ev isio n 1 8
IO310NB7F29
N10
IO310PB7F29
N9
IO311NB7F29
K1
IO311PB7F29
L1
IO313NB7F29
M5
IO316NB7F29
L6
IO316PB7F29
L5
IO317NB7F29
K2
IO317PB7F29
L2
IO318NB7F29
K4
IO318PB7F29
L4
IO320NB7F29
J3
IO321NB7F30
J2
IO321PB7F30
J1
IO323NB7F30
L7
IO323PB7F30
M7
IO324NB7F30
M9
IO324PB7F30
M8
IO327NB7F30
F1
IO327PB7F30
G1
IO328NB7F30
K7
IO328PB7F30
K6
IO329NB7F30
D1
IO329PB7F30
E1
IO331PB7F30
G2
IO332NB7F31
H3
IO332PB7F31
H2
IO333NB7F31
E2
IO333PB7F31
F2
IO334NB7F31
H4
IO334PB7F31
J4
IO335NB7F31
H5
CG624
AX2000 Function
Pin
Number
Note:
*Not routed on the same
package layer and to adjacent
LGA pads as its differential
pair complement.
Recommended to be used as
a single-ended I/O.
IO335PB7F31
H6
IO337NB7F31
D2
IO338NB7F31
J6
IO338PB7F31
J5
IO339NB7F31
F3
IO339PB7F31
E3
IO340NB7F31
G4*
IO340PB7F31
G3*
IO341NB7F31
K8
IO341PB7F31
L8
Dedicated I/O
GND
K5
GND
A18
GND
A2
GND
A24
GND
A25
GND
A8
GND
AA10
GND
AA16
GND
AA18
GND
AA21
GND
AA5
GND
AB22
GND
AB4
GND
AC10
GND
AC16
GND
AC23
GND
AC3
GND
AD1
GND
AD2
GND
AD24
GND
AD25
CG624
AX2000 Function
Pin
Number
Note:
*Not routed on the same
package layer and to adjacent
LGA pads as its differential
pair complement.
Recommended to be used as
a single-ended I/O.
GND
AE1
GND
AE18
GND
AE2
GND
AE24
GND
AE25
GND
AE8
GND
B1
GND
B2
GND
B24
GND
B25
GND
C10
GND
C16
GND
C23
GND
C3
GND
D22
GND
D4
GND
E10
GND
E16
GND
E21
GND
E5
GND
E8
GND
H1
GND
H21
GND
H25
GND
K21
GND
K23
GND
K3
GND
L11
GND
L12
GND
L13
GND
L14
GND
L15
CG624
AX2000 Function
Pin
Number
Note:
*Not routed on the same
package layer and to adjacent
LGA pads as its differential
pair complement.
Recommended to be used as
a single-ended I/O.
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