參數(shù)資料
型號(hào)： ATMEGA169P-16MCHR
廠商： Atmel
文件頁數(shù)： 100/274頁
文件大?。?/td> 0K
描述： MCU AVR 16KB FLASH 16MHZ 64-VQFN
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
megaAVR Introduction
標(biāo)準(zhǔn)包裝： 4,000
系列： AVR® ATmega
核心處理器： AVR
芯體尺寸： 8-位
速度： 16MHz
連通性： SPI，UART/USART，USI
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲(chǔ)器容量： 16KB（8K x 16）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-VQFN 雙排裸露焊盤
包裝： 帶卷 (TR)
配用： ATSTK600-ND - DEV KIT FOR AVR/AVR32
ATAVRBFLY-ND - KIT EVALUATION AVR BUTTERFLY
ATSTK502-ND - MOD EXPANSION AVR STARTER 500
ATSTK500-ND - PROGRAMMER AVR STARTER KIT
其它名稱： ATMEGA169P-16MCHR SL383
ATMEGA169P-16MCHR-ND
ATMEGA169P-16MCHRTR
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2005 Microchip Technology Inc.
Preliminary
DS41265A-page 187
PIC16F946
FIGURE 15-5:
SIMPLIFIED PWM BLOCK
DIAGRAM
A PWM output (Figure 15-6) has a time base (period)
and a time that the output stays high (duty cycle). The
frequency of the PWM is the inverse of the period
(1/period).
FIGURE 15-6:
PWM OUTPUT
15.3.1
PWM PERIOD
The PWM period is specified by writing to the PR2
register. The PWM period can be calculated using the
following formula:
PWM frequency is defined as 1/[PWM period].
When TMR2 is equal to PR2, the following three events
occur on the next increment cycle:
TMR2 is cleared
The RC5/T1CKI/CCP1/SEG10 pin is set
(exception: if PWM duty cycle = 0%, the
RC5/T1CKI/CCP1/SEG10 pin will not be set)
The PWM duty cycle is latched from CCPR1L into
CCPR1H
15.3.2
PWM DUTY CYCLE
The PWM duty cycle is specified by writing to the
CCPR1L register and to the CCP1CON<5:4> bits. Up
to 10-bit resolution is available. The CCPR1L contains
the eight MSbs and the CCP1CON<5:4> contains the
two LSbs. This 10-bit value is represented by
CCPR1L:CCP1CON<5:4>. The following equation is
used to calculate the PWM duty cycle in time:
CCPR1L and CCP1CON<5:4> can be written to at any
time, but the duty cycle value is not latched into
CCPR1H until after a match between PR2 and TMR2
occurs (i.e., the period is complete). In PWM mode,
CCPR1H is a read-only register.
The CCPR1H register and a 2-bit internal latch are
used to double buffer the PWM duty cycle. This double
buffering is essential for glitch-free PWM operation.
When the CCPR1H and 2-bit latch match TMR2, con-
catenated with an internal 2-bit Q clock, or 2 bits of the
TMR2 prescaler, the CCP1 pin is cleared.
The maximum PWM resolution (bits) for a given PWM
frequency is given by the formula:
CCPR1L
CCPR1H (Slave)
Comparator
TMR2
Comparator
PR2
(1)
R
Q
S
Duty Cycle Registers
CCP1CON<5:4>
Clear Timer,
CCP1 pin and
latch D.C.
TRISC<5>
RC5/T1CKI/
Note
1:
The 8-bit timer is concatenated with 2-bit internal Q
clock, or 2 bits of the prescaler, to create 10-bit time
base.
CCP1/SEG10
Period
Duty Cycle
TMR2 = PR2
TMR2 = Duty Cycle
TMR2 = PR2
PWM period = (PR2) + 1] 4 TOSC
(TMR2 prescale value)
Note:
The Timer2 postscaler (see Section 7.0
“Timer2 Module”) is not used in the
determination of the PWM frequency. The
postscaler could be used to have a servo
update rate at a different frequency than
the PWM output.
Note:
If the PWM duty cycle value is longer than
the
PWM
period,
the
RC5/T1CKI/CCP1/SEG10 pin will not be
cleared.
PWM duty cycle =(CCPR1L:CCP1CON<5:4>)
TOSC (TMR2 prescale value)
PWM Resolution
FOSC
FPWM
TMR2 Prescaler
×
-------------------------------------------------------------
log
2
()
log
---------------------------------------------------------------------------bits
=
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PDF描述
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ATMEGA169P-8AU 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Microcontroller with 16K Bytes In-System Programmable Flash
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