參數(shù)資料
型號(hào)： ATF1502ASV-15JI44
廠商： Atmel
文件頁(yè)數(shù)： 22/25頁(yè)
文件大?。?/td> 0K
描述： IC CPLD EE HP 15NS 44-PLCC
標(biāo)準(zhǔn)包裝： 27
系列： ATF15xx
可編程類型： 系統(tǒng)內(nèi)可編程（最少 10,000 次編程/擦除循環(huán)）
最大延遲時(shí)間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
宏單元數(shù)： 32
輸入/輸出數(shù)： 32
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC
包裝： 管件
6
1615J–PLD–01/06
ATF1502ASV
floating to intermediate voltage levels, which causes unnecessary power consumption and sys-
tem noise. The keeper circuits eliminate the need for external pull-up resistors and eliminate
their DC power consumption.
Figure 2-1.
Input Diagram
Figure 2-2.
I/O Diagram
3.
Speed/Power Management
The ATF1502ASV has several built-in speed and power management features.
To further reduce power, each ATF1502ASV macrocell has a reduced-power bit feature. To
reduce power consumption this feature may be actived (by changing the default value of OFF to
ON) for any or all macrocells.
The ATF1502ASV also has an optional power-down mode. In this mode, current drops to below
15 mA. When the power-down option is selected, either PD1 or PD2 pins (or both) can be used
to power down the part. The power-down option is selected in the design source file. When
enabled, the device goes into power-down when either PD1 or PD2 is high. In the power-down
mode, all internal logic signals are latched and held, as are any enabled outputs.
VCC
PROGRAMMABLE
OPTION
100K
INPUT
ESD
PROTECTION
CIRCUIT
OE
DATA
VCC
PROGRAMMABLE
OPTION
100K
VCC
I/O
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PDF描述
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