參數(shù)資料
型號(hào): ATA8743-PXQW
廠商: Atmel
文件頁(yè)數(shù): 29/238頁(yè)
文件大?。?/td> 3971K
描述: MCU W/TRANSMITTER ASK/FSK 24QFN
產(chǎn)品培訓(xùn)模塊: MCU Product Line Introduction
標(biāo)準(zhǔn)包裝: 6,000
頻率: 868MHz ~ 928MHz
應(yīng)用: 家庭自動(dòng)化,遙感,RKE
調(diào)制或協(xié)議: ASK,F(xiàn)SK
數(shù)據(jù)傳輸率 - 最大: 32 kBit/s
功率 - 輸出: 3.5dBm ~ 8dBm
電流 - 傳輸: 9.3mA
數(shù)據(jù)接口: PCB,表面貼裝
天線連接器: PCB,表面貼裝
存儲(chǔ)容量: 4kB 閃存,256B EEPROM,256B SRAM
電源電壓: 1.8 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
封裝/外殼: 24-VQFN 裸露焊盤(pán)
包裝: 帶卷 (TR)
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9152BINDCO02/10
ATA8743
When an interrupt occurs, the Global Interrupt Enable I-bit is cleared and all interrupts are dis-
abled. The user software can write logic one to the I-bit to enable nested interrupts. All enabled
interrupts can then interrupt the current interrupt routine. The I-bit is automatically set when a
Return from Interrupt instruction  RETI  is executed.
There are basically two types of interrupts. The first type is triggered by an event that sets the
Interrupt Flag. For these interrupts, the Program Counter is vectored to the actual Interrupt Vec-
tor in order to execute the interrupt handling routine, and hardware clears the corresponding
Interrupt Flag. Interrupt Flags can also be cleared by writing a logic one to the flag bit position(s)
to be cleared. If an interrupt condition occurs while the corresponding interrupt enable bit is
cleared, the Interrupt Flag will be set and remembered until the interrupt is enabled, or the flag is
cleared by software. Similarly, if one or more interrupt conditions occur while the Global Interrupt
Enable bit is cleared, the corresponding Interrupt Flag(s) will be set and remembered until the
Global Interrupt Enable bit is set, and will then be executed by order of priority.
The second type of interrupts will trigger as long as the interrupt condition is present. These
interrupts do not necessarily have Interrupt Flags. If the interrupt condition disappears before the
interrupt is enabled, the interrupt will not be triggered.
When the AVR exits from an interrupt, it will always return to the main program and execute one
more instruction before any pending interrupt is served.
Note that the Status Register is not automatically stored when entering an interrupt routine, nor
restored when returning from an interrupt routine. This must be handled by software.
When using the CLI instruction to disable interrupts, the interrupts will be immediately disabled.
No interrupt will be executed after the CLI instruction, even if it occurs simultaneously with the
CLI instruction. The following example shows how this can be used to avoid interrupts during the
timed EEPROM write sequence..
Assembly Code Example
in  r16, SREG
; store SREG value
cli
; disable interrupts during timed sequence
sbi EECR, EEMPE     start EEPROM write
sbi EECR, EEPE
out SREG, r16
; restore SREG value (I-bit)
C Code Example
char cSREG;
cSREG = SREG; /* store SREG value */
/* disable interrupts during timed sequence */
_CLI();
EECR |= (1</* start EEPROM write */
EECR |= (1<
SREG = cSREG; /* restore SREG value (I-bit) */
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PDF描述
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參數(shù)描述
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ATAB5279 功能描述:射頻開(kāi)發(fā)工具 LF Transmitter with ATA5279 RoHS:否 制造商:Taiyo Yuden 產(chǎn)品:Wireless Modules 類(lèi)型:Wireless Audio 工具用于評(píng)估:WYSAAVDX7 頻率: 工作電源電壓:3.4 V to 5.5 V
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