參數(shù)資料
型號： ATA8743-PXQW
廠商： Atmel
文件頁數(shù)： 153/238頁
文件大?。?/td> 3971K
描述： MCU W/TRANSMITTER ASK/FSK 24QFN
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 6,000
頻率： 868MHz ~ 928MHz
應(yīng)用： 家庭自動(dòng)化，遙感，RKE
調(diào)制或協(xié)議： ASK，F(xiàn)SK
數(shù)據(jù)傳輸率 - 最大： 32 kBit/s
功率 - 輸出： 3.5dBm ~ 8dBm
電流 - 傳輸： 9.3mA
數(shù)據(jù)接口： PCB，表面貼裝
天線連接器： PCB，表面貼裝
存儲容量： 4kB 閃存，256B EEPROM，256B SRAM
電源電壓： 1.8 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
封裝/外殼： 24-VQFN 裸露焊盤
包裝： 帶卷 (TR)
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153
9152BINDCO02/10
ATA8743
"  Bit 2  ACIC: Analog Comparator Input Capture Enable
When written logic one, this bit enables the input capture function in Timer/Counter1 to be trig-
gered by the Analog Comparator. The comparator output is in this case directly connected to the
input capture front-end logic, making the comparator utilize the noise canceler and edge select
features of the Timer/Counter1 Input Capture interrupt. When written logic zero, no connection
between the Analog Comparator and the input capture function exists. To make the comparator
trigger the Timer/Counter1 Input Capture inter-rupt, the ICIE1 bit in the Timer Interrupt Mask
Register (TIMSK1) must be set.
"  Bits 1, 0  ACIS1, ACIS0: Analog Comparator Interrupt Mode Select
These bits determine which comparator events that trigger the Analog Comparator interrupt. The
different settings are shown in Table 24-2.
When changing the ACIS1/ACIS0 bits, the Analog Comparator Interrupt must be disabled by
clearing its Interrupt Enable bit in the ACSR Register. Otherwise an interrupt can occur when the
bits are changed.
24.2.3
DIDR0  Digital Input Disable Register 0
"  Bits 1, 0  ADC0D,ADC1D: ADC 1/0 Digital input buffer disable
When this bit is written logic one, the digital input buffer on the AIN1/0 pin is disabled. The corre-
sponding PIN Register bit will always read as zero when this bit is set. When an analog signal is
applied to the AIN1/0 pin and the digital input from this pin is not needed, this bit should be writ-
ten logic one to reduce power consumption in the digital input buffer.
Table 24-2.    ACIS1/ACIS0 Settings
ACIS1
ACIS0
Interrupt Mode
0
0
Comparator Interrupt on Output Toggle.
0
1
Reserved
1
0
Comparator Interrupt on Falling Output Edge.
1
1
Comparator Interrupt on Rising Output Edge.
Bit
7
6
5
4
3
2
1
0
0x01 (0x21)
ADC7D
ADC6D
ADC5D
ADC4D
ADC3D
ADC2D
ADC1D
ADC0D
DIDR0
Read/Write
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Initial Value
0
0
0
0
0
0
0
0
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PDF描述
ATAVRRZ200 KIT DEMO AT86RF230
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