參數(shù)資料
型號： AT90S8515-8PC
廠商： Atmel
文件頁數(shù)： 107/112頁
文件大?。?/td> 0K
描述： IC MCU 8K FLSH 8MHZ 40DIP
標準包裝： 18
系列： AVR® 90S
核心處理器： AVR
芯體尺寸： 8-位
速度： 8MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 32
程序存儲器容量： 8KB（4K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 6 V
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 40-DIP（0.600"，15.24mm）
包裝： 管件
94
AT90S8515
0841G–09/01
Notes:
1. This assumes 50% clock duty cycle. The half-period is actually the high time of the external clock, XTAL1.
2. This assumes 50% clock duty cycle. The half-period is actually the low time of the external clock, XTAL1.
Table 39. External Data Memory Characteristics, 2.7V - 4.0V, No Wait State
Symbol
Parameter
4 MHz Oscillator
Variable Oscillator
Unit
Min
Max
Min
Max
01/tCLCL
Oscillator Frequency
0.0
4.0
MHz
1t
LHLL
ALE Pulse Width
70.0
0.5 t
CLCL - 55.0
ns
2t
AVLL
Address Valid A to ALE Low
60.0
0.5 t
CLCL - 65.0
ns
3a
t
LLAX_ST
Address Hold after ALE Low,
ST/STD/STS Instructions
130.0
0.5 t
CLCL + 5.0
ns
3b
t
LLAX_LD
Address Hold after ALE Low,
LD/LDD/LDS Instructions
15.0
ns
4t
AVLLC
Address Valid C to ALE Low
60.0
0.5 t
CLCL - 65.0
ns
5t
AVRL
Address Valid to RD Low
200.0
1.0 t
CLCL - 50.0
ns
6tAVWL
Address Valid to WR Low
325.0
1.5 tCLCL - 50.0
ns
7t
LLWL
ALE Low to WR Low
230.0
270.0
1.0 t
CLCL - 20.0
1.0 t
CLCL + 20.0
ns
8t
LLRL
ALE Low to RD Low
105.0
145.0
0.5 t
CLCL - 20.0
0.5 t
CLCL + 20.0
ns
9tDVRH
Data Setup to RD High
95.0
ns
10
t
RLDV
Read Low to Data Valid
170.0
1.0 t
CLCL - 80.0
ns
11
t
RHDX
Data Hold after RD High
0.0
ns
12
tRLRH
RD Pulse Width
230.0
1.0 tCLCL - 20.0
ns
13
t
DVWL
Data Setup to WR Low
70.0
0.5 t
CLCL - 55.0
ns
14
t
WHDX
Data Hold after WR High
0.0
ns
15
tDVWH
Data Valid to WR High
210.0
1.0 tCLCL - 40.0
ns
16
t
WLWH
WR Pulse Width
105.0
0.5 t
CLCL - 20.0
ns
Table 40. External Data Memory Characteristics, 2.7V - 4.0V, One Cycle Wait State
Symbol
Parameter
4 MHz Oscillator
Variable Oscillator
Unit
Min
Max
Min
Max
01/t
CLCL
Oscillator Frequency
0.0
4.0
MHz
10
tRLDV
Read Low to Data Valid
420.00
2.0 tCLCL - 80.0
ns
12
t
RLRH
RD Pulse Width
480.0
2.0 t
CLCL - 20.0
ns
15
t
DVWH
Data Valid to WR High
460.0
2.0 t
CLCL - 40.0
ns
16
tWLWH
WR Pulse Width
355.0
1.5 tCLCL - 20.0
ns
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