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參數(shù)資料
| 型號(hào)： | AT89LP828-20JU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 130/149頁 |
| 文件大小： | 0K |
| 描述： | MCU 8051 8K FLASH SPI 32PLCC |
| 產(chǎn)品培訓(xùn)模塊： | MCU Product Line Introduction |
| 標(biāo)準(zhǔn)包裝： | 32 |
| 系列： | 89LP |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 30 |
| 程序存儲(chǔ)器容量： | 8KB（8K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| EEPROM 大?。?/td> | 1K x 8 |
| RAM 容量： | 768 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 32-LCC（J 形引線） |
| 包裝： | 管件 |
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81
3654A–MICRO–8/09
AT89LP428/828
16.3
More About Mode 0
In Mode 0, the UART is configured as a 2-wire half-duplex synchronous serial interface. Serial
data enters and exits through RXD. TXD outputs the shift clock. Eight data bits are transmit-
ted/received, with the LSB first. Figure 16-1 on page 83 shows a simplified functional diagram of
the serial port in Mode 0 and associated timing. The baud rate is programmable to 1/2 or 1/4 the
oscillator frequency by setting/clearing the SMOD1 bit. However, changing SMOD1 has an
effect on the relationship between the clock and data as described below. The baud rate can
also be generated by Timer 1 by setting TB8. Table 16-4 lists the baud rate options for Mode 0.
Transmission is initiated by any instruction that uses SBUF as a destination register. The “write
to SBUF” signal also loads a “1” into the 9th position of the transmit shift register and tells the TX
Control Block to begin a transmission. The internal timing is such that one full bit slot may elapse
between “write to SBUF” and activation of SEND.
SEND transfers the output of the shift register to the alternate output function line of P3.0, and
also transfers Shift Clock to the alternate output function line of P3.1. As data bits shift out to the
right, “0”s come in from the left. When the MSB of the data byte is at the output position of the
shift register, the “1” that was initially loaded into the 9th position is just to the left of the MSB,
and all positions to the left of that contain “0”s. This condition flags the TX Control block to do
one last shift, then deactivate SEND and set TI.
Table 16-3.
Commonly Used Baud Rates Generated by Timer 2 (TPS = 0000B)
Baud Rate
f
OSC (MHz)
Timer 2
CP/RL2
C/T2
TCLK or RCLK
Reload Value
62.5K
12
0
1
FFF4H
19.2K
11.059
0
1
FFDCH
9.6K
11.059
0
1
FFB8H
4.8K
11.059
0
1
FF70H
2.4K
11.059
0
1
FEE0H
1.2K
11.059
0
1
FDC0H
137.5
11.986
0
1
EAB8H
110
6
0
1
F2AFH
110
12
0
1
E55EH
Table 16-4.
Mode 0 Baud Rates
TB8
SMOD1
Baud Rate
00
f
SYS/4
01
f
SYS/2
1
0
(Timer 1 Overflow)/4
1
(Timer 1 Overflow)/2
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