參數(shù)資料
型號： AT32UC3C0512CAU-ALUT
廠商： Atmel
文件頁數(shù)： 53/110頁
文件大?。?/td> 0K
描述： IC MCU AVR32 512K FLASH 144LQFP
產(chǎn)品培訓模塊： AVR® UC3 Introduction
標準包裝： 300
系列： AVR®32 UC3 C Audio
核心處理器： AVR
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，以太網(wǎng)，I²C，IrDA，LIN，SPI，UART/USART，USB
外圍設備： 欠壓檢測/復位，DMA，I²S，POR，PWM，WDT
輸入/輸出數(shù)： 123
程序存儲器容量： 512KB（512K x 8）
程序存儲器類型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b，D/A 4x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 160-LQFP
包裝： 托盤
47
32117DS–AVR-01/12
AT32UC3C
The 3.3V regulator is connected to the 5V source (VDDIN_5 pin) and its output feeds the USB
pads. If the USB is not used, the 3.3V regulator can be disabled through the VREG33CTL field
of the VREGCTRL SCIF register.
Figure 6-1 on page 47 shows the power schematics to be used for 5V single supply mode. All
I/O lines and analog blocks will be powered by the same power (VDDIN_5 = VDDIO1 = VDDIO2
= VDDIO3 = VDDANA).
Figure 6-1.
5V Single Power Supply mode
6.1.3.2
3.3V Single Supply Mode
In 3.3V single supply mode, the VDDIN_5 and VDDIN_33 pins should be connected together
externally. The 1.8V internal regulator is connected to the 3.3 V source (VDDIN_5 pin) and its
output feeds VDDCORE.
The 3.3V regulator should be disabled once the circuit is running through the VREG33CTL field
of the VREGCTRL SCIF register.
Figure 6-2 on page 48 shows the power schematics to be used for 3.3V single supply mode. All
I/O lines and analog blocks will be powered by the same power (VDDIN_5 = VDDIN_33 =
VDDIO1 = VDDIO2 = VDDIO3 = VDDANA).
VDDIO1
VDDIO2
VDDIO3
CPU
Peripherals
Memories
SCIF, BOD,
RCSYS
3.3V
Reg
+
-
Analog: ADC, AC, DAC, ...
VDDIN_5
VDDANA
GNDANA
VDDCORE
COUT2
COUT1
GNDCORE
GNDPLL
PLL
GNDIO1
GNDIO2
GNDIO3
BOD50
BOD18
BOD33
1.8V
Reg
POR
CIN2
CIN1
VDDIN_33
COUT2
COUT1
4.5-
5.5V
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PDF描述
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