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參數(shù)資料
| 型號(hào)： | AT27LV256A-70JI |
| 廠商： | ATMEL CORP |
| 元件分類(lèi)： | DRAM |
| 英文描述： | High Speed CMOS Logic 14-Stage Binary Counter with Oscillator 16-SOIC -55 to 125 |
| 中文描述： | 32K X 8 OTPROM, 70 ns, PQCC32 |
| 封裝： | PLASTIC, MS-016AE, LCC-32 |
| 文件頁(yè)數(shù)： | 5/9頁(yè) |
| 文件大?。?/td> | 221K |
| 代理商： | AT27LV256A-70JI |
AC Characteristics for Read Operation
(V
CC
= 3.0V to 3.6V and 4.5V to 5.5V)
AT27LV256A
-70
-90
-12
-15
Symbol
t
ACC
(
3
)
t
CE
(
2
)
t
OE (2, 3)
Parameter
Address to Output Delay
CE to Output Delay
OE to Output Delay
OE or CE High to Output Float,
whichever occurred first
Output Hold from Address, CE or
OE, whichever occurred first
Condition
CE = OE = V
IL
OE = V
IL
CE = V
IL
Min
Max
Min
Max
Min
Max
Min
Max
Units
ns
ns
ns
70
70
50
90
90
50
120
120
50
150
150
60
t
DF (4, 5)
40
40
40
50
ns
t
OH
0
0
0
0
ns
Notes:
2, 3, 4, 5. - see AC Waveforms for Read Operation.
AC Waveforms for Read Operation
(1)
Notes: 1. Timing measurement references are 0.8V and 2.0V.
Input AC drive levels are 0.45V and 2.4V, unless
otherwise specified.
2. OE may be delayed up to t
CE
- t
OE
after the falling edge
of CE without impact on t
CE
.
3. OE may be delayed up to t
ACC
- t
OE
after the
address is valid without impact on t
ACC
.
4. This parameter is only sampled and is not 100% tested.
5. Output float is defined as the point when data is no longer
driven.
AT27LV256A
3-79
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