參數(shù)資料
型號(hào)： AT17LV512A
廠商： Atmel Corp.
元件分類(lèi)： FPGA
英文描述： FPGA Configuration EEPROM Memory
中文描述： FPGA配置EEPROM存儲(chǔ)器
文件頁(yè)數(shù)： 4/14頁(yè)
文件大?。?/td> 242K
代理商： AT17LV512A
4
AT17C/LV002A
2280B
–
08/01
Figure 1.
Configuration with a Single AT17A Series Configurator
(1)(2)(3)
Notes:
1. Use of the READY pin is optional.
2. Introducing an RC delay to the input of nCONFIG is recommended to ensure that V
CC
(5V/3.3V) is reached before
configuration begins. (nCONFIG can instead be connected to an active Low system reset signal.)
3. Reset polarity of EEPROM must be set active Low (OE active High).
Figure 2.
Configuration with Multiple AT17A Series Configurators
(1)(2)(3)
Notes:
1. Use of the READY pin is optional.
2. Introducing an RC delay to the input of nCONFIG is recommended to ensure that V
CC
(5V/3.3V) is reached before
configuration begins. (nCONFIG can instead be connected to an active Low system reset signal.)
3. Reset polarity of EEPROM must be set active Low (OE active High).
MSEL1
nSTATUS
MSEL0
CONF_DONE
DATA0
DCLK
nCONFIG
EPF6K/EPF10K
AT17C512A/010A/020A/002A
AT17LV512A/010A/020A/002A
GND
OE
nCS
DATA
DCLK
nCE
READY
V
CC
SER_EN
V
CC
V
CC
V
CC
0.1
m
F
1 k
W
1 k
W
1 k
W
MSEL1
nSTATUS
MSEL0
CONF_DONE
DATA0
DCLK
nCONFIG
EPF10K
AT17C512A/010A/020A/002A
AT17LV512A/010A/020A/002A
DEVICE 1
GND
OE
nCS
nCASC
DATA
DCLK
AT17C512A/010A/020A/002A
AT17LV512A/010A/020A/002A
DEVICE 2
OE
nCS
DATA
DCLK
READY
V
CC
V
CC
V
CC
1 k
W
1 k
W
1 k
W
nCE
SER_EN
V
CC
0.1
m
F
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PDF描述
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