參數(shù)資料
型號: AK4101A
廠商: Asahi Kasei Microsystems Co.,Ltd
英文描述: QUAD OUTPUTS 192KHZ 24 BIT DIT
中文描述: 四輸出192kHz的24位動態(tài)網(wǎng)
文件頁數(shù): 27/29頁
文件大小: 317K
代理商: AK4101A
ASAHI KASEI
[AK4101A]
MS0250-E-00
2003/07
- 7 -
SWITCHING CHARACTERISTICS
(Ta=25
°C; VDD=4.75~5.25V; C
L=20pF)
Parameter
Symbol
min
typ
max
Units
Master Clock Timing
Frequency
Duty Cycle
fCLK
dCLK
3.584
40
27.648
60
MHz
%
LRCK Timing
Frequency
Duty Cycle at Slave Mode
Duty Cycle at Master Mode
fs
dLCK
28
45
50
192
55
kHz
%
Audio Interface Timing
Slave Mode
BICK Period
BICK Pulse Width Low
Pulse Width High
LRCK Edge to BICK “
↑”
(Note 5)
BICK “
↑” to LRCK Edge
(Note 5)
SDTI Hold Time
SDTI Setup Time
tBCK
tBCKL
tBCKH
tLRB
tBLR
tSDH
tSDS
36
15
8
ns
Master Mode
BICK Frequency
BICK Duty
BICK “
↓” to LRCK
SDTI Hold Time
SDTI Setup Time
fBCK
dBCK
tMBLR
tSDH
tSDS
-20
20
64fs
50
20
Hz
%
ns
Control Interface Timing
CCLK Period
CCLK Pulse Width Low
Pulse Width High
CDTI Setup Time
CDTI Hold Time
CSN “H” Time
CSN “
↓” to CCLK “↑”
CCLK “
↑” to CSN “↑”
CDTO Delay
CSN “
↑” to CDTO Hi-Z
(Note 6)
tCCK
tCCKL
tCCKH
tCDS
tCDH
tCSW
tCSS
tCSH
tDCD
tCCZ
200
80
50
520
50
45
70
ns
Power-down & Reset Timing
PDN Pulse Width
tPDW
150
ns
Notes:
5. BICK rising edge must not occur at the same time as LRCK edge.
6. CDTO pin is internally connected to a pull-down resistor.
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