Revision 16 2-15 User I/O Characteristics Timing Model Figure 2-3 Timing Model Operating" />
參數(shù)資料
型號： AGLP125V2-CSG281I
廠商： Microsemi SoC
文件頁數(shù)： 57/134頁
文件大?。?/td> 0K
描述： IC FPGA IGLOO PLUS 125K 281-CSP
標(biāo)準(zhǔn)包裝： 184
系列： IGLOO PLUS
邏輯元件/單元數(shù)： 3120
RAM 位總計： 36864
輸入/輸出數(shù)： 212
門數(shù)： 125000
電源電壓： 1.14 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 281-TFBGA，CSBGA
供應(yīng)商設(shè)備封裝： 281-CSP（10x10）
IGLOO PLUS Low Power Flash FPGAs
Revision 16
2-15
User I/O Characteristics
Timing Model
Figure 2-3 Timing Model
Operating Conditions: STD Speed, Commercial Temperature Range (TJ = 70°C), Worst-Case
VCC = 1.425 V, for DC 1.5 V Core Voltage, Applicable to V2 and V5 Devices
DQ
Y
DQ
Y
Combinational Cell
I/O Module
(Registered)
I/O Module
(Non-Registered)
Register Cell
I/O Module
(Registered)
I/O Module
(Non-Registered)
LVCMOS 2.5 V Output Drive
Strength = 12 mA High Slew Rate
Input LVCMOS 2.5 V
LVCMOS 1.5 V
LVTTL 3.3 V Output drive
strength = 12 mA High slew rate
Y
Combinational Cell
Y
Combinational Cell
Y
Combinational Cell
I/O Module
(Non-Registered)
LVTTLOutput drive strength = 8 mA
High slew rate
I/O Module
(Non-Registered)
LVCMOS 1.5 VOutput drive strength = 4 mA
High slew rate
LVTTLOutput drive strength = 12 mA
High slew rate
I/O Module
(Non-Registered)
Input LVTTL
Clock
Input LVTTL
Clock
Input LVTTL
Clock
tPD = 1.40 ns
tPD = 0.89 ns
tDP = 1.62 ns
tPD = 1.98 ns
tDP = 1.62 ns
tPD = 1.24 ns
tDP = 1.70 ns
tPD = 0.86 ns
tDP = 2.07 ns
tPD = 0.87 ns
tPY = 0.85 ns
tCLKQ = 0.80 ns
tOCLKQ = 0.89 ns
tSUD = 0.84 ns
tOSUD = 0.18 ns
tDP = 1.62 ns
tPY = 0.85 ns
tPY = 1.15 ns
tCLKQ = 0.80 ns
tSUD = 0.84 ns
tPY = 0.85 ns
tICLKQ = 0.63 ns
tISUD = 0.18 ns
tPY = 1.06 ns
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PDF描述
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