2-120 Revision 4 Analog System Characteristics Table 2-49 Analog Channel Specifications Commercial Te" />
參數(shù)資料
型號： AFS600-FGG484I
廠商： Microsemi SoC
文件頁數(shù)： 42/334頁
文件大小： 0K
描述： IC FPGA 4MB FLASH 600K 484FBGA
標(biāo)準(zhǔn)包裝： 60
系列： Fusion®
RAM 位總計： 110592
輸入/輸出數(shù)： 172
門數(shù)： 600000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
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Device Architecture
2-120
Revision 4
Analog System Characteristics
Table 2-49 Analog Channel Specifications
Commercial Temperature Range Conditions, TJ = 85°C (unless noted otherwise),
Typical: VCC33A = 3.3 V, VCC = 1.5 V
Parameter
Description
Condition
Min.
Typ.
Max.
Units
Voltage Monitor Using Analog Pads AV, AC and AT (using prescaler)
Input Voltage
(Prescaler)
VINAP
Uncalibrated Gain and
Offset Errors
Refer to Table 2-51 on
Calibrated Gain and
Offset Errors
Refer to Table 2-52 on
Bandwidth1
100
KHz
Input Resistance
Scaling Factor
Prescaler modes (Table 2-57 on
Sample Time
10
s
Current Monitor Using Analog Pads AV and AC
VRSM1
Maximum Differential
Input Voltage
VAREF / 10
mV
Resolution
Common Mode Range
– 10.5 to +12
V
CMRR
Common Mode
Rejection Ratio
DC – 1 KHz
60
dB
1 KHz - 10 KHz
50
dB
> 10 KHz
30
dB
tCMSHI
Strobe High time
ADC
conv.
time
200
s
tCMSHI
Strobe Low time
5
s
tCMSHI
Settling time
0.02
s
Accuracy
Input differential voltage > 50 mV
–2 –(0.05 x
VRSM) to +2 +
(0.05 x VRSM)
mV
Notes:
1. VRSM is the maximum voltage drop across the current sense resistor.
2. Analog inputs used as digital inputs can tolerate the same voltage limits as the corresponding analog pad. There is no
reliability concern on digital inputs as long as VIND does not exceed these limits.
3. VIND is limited to VCC33A + 0.2 to allow reaching 10 MHz input frequency.
4. An averaging of 1,024 samples (LPF setting in Analog System Builder) is required and the maximum capacitance
allowed across the AT pins is 500 pF.
5. The temperature offset is a fixed positive value.
6. The high current mode has a maximum power limit of 20 mW. Appropriate current limit resistors must be used, based on
voltage on the pad.
7. When using SmartGen Analog System Builder, CalibIP is required to obtain 0 offset. For further details on CalibIP, refer
to the "Temperature, Voltage, and Current Calibration in Fusion FPGAs" chapter of the Fusion FPGA Fabric User’s
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AFS600-FPQ208 制造商:Microsemi Corporation 功能描述:FPGA FUSION 600K GATES 130NM 1.5V 208PQFP - Trays
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AFS600-FPQ256PP 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs
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