參數(shù)資料
型號(hào)： AFS250-1QNG180I
廠商： Microsemi SoC
文件頁(yè)數(shù)： 1/334頁(yè)
文件大小： 0K
描述： IC FPGA 2MB FLASH 250K 180-QFN
標(biāo)準(zhǔn)包裝： 184
系列： Fusion®
RAM 位總計(jì)： 36864
輸入/輸出數(shù)： 65
門數(shù)： 250000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 180-WFQFN
供應(yīng)商設(shè)備封裝： 180-QFN（10x10）
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January 2013
I
2013 Microsemi Corporation
Fusion Family of Mixed Signal FPGAs
Features and Benefits
High-Performance Reprogrammable Flash Technology
Advanced 130-nm, 7-Layer Metal, Flash-Based CMOS Process
Nonvolatile, Retains Program when Powered Off
Instant On Single-Chip Solution
350 MHz System Performance
Embedded Flash Memory
User Flash Memory – 2 Mbits to 8 Mbits
– Configurable 8-, 16-, or 32-Bit Datapath
– 10 ns Access in Read-Ahead Mode
1 Kbit of Additional FlashROM
Integrated A/D Converter (ADC) and Analog I/O
Up to 12-Bit Resolution and up to 600 Ksps
Internal 2.56 V or External Reference Voltage
ADC: Up to 30 Scalable Analog Input Channels
High-Voltage Input Tolerance: –10.5 V to +12 V
Current Monitor and Temperature Monitor Blocks
Up to 10 MOSFET Gate Driver Outputs
– P- and N-Channel Power MOSFET Support
– Programmable 1, 3, 10, 30 A, and 20 mA Drive Strengths
ADC Accuracy is Better than 1%
On-Chip Clocking Support
Internal 100 MHz RC Oscillator (accurate to 1%)
Crystal Oscillator Support (32 KHz to 20 MHz)
Programmable Real-Time Counter (RTC)
6 Clock Conditioning Circuits (CCCs) with 1 or 2 Integrated PLLs
– Phase Shift, Multiply/Divide, and Delay Capabilities
– Frequency: Input 1.5–350 MHz, Output 0.75–350 MHz
Low Power Consumption
Single 3.3 V Power Supply with On-Chip 1.5 V Regulator
Sleep and Standby Low-Power Modes
In-System Programming (ISP) and Security
ISP with 128-Bit AES via JTAG
FlashLock Designed to Protect FPGA Contents
Advanced Digital I/O
1.5 V, 1.8 V, 2.5 V, and 3.3 V Mixed-Voltage Operation
Bank-Selectable I/O Voltages – Up to 5 Banks per Chip
Single-Ended I/O Standards: LVTTL, LVCMOS
3.3 V / 2.5 V /1.8 V / 1.5 V, 3.3 V PCI / 3.3 V PCI-X, and
LVCMOS 2.5 V / 5.0 V Input
Differential I/O Standards: LVPECL, LVDS, B-LVDS, M-LVDS
– Built-In I/O Registers
– 700 Mbps DDR Operation
Hot-Swappable I/Os
Programmable Output Slew Rate, Drive Strength, and Weak
Pull-Up/Down Resistor
Pin-Compatible Packages across the Fusion Family
SRAMs and FIFOs
Variable-Aspect-Ratio 4,608-Bit SRAM Blocks (×1, ×2, ×4, ×9,
and ×18 organizations available)
True Dual-Port SRAM (except ×18)
Programmable Embedded FIFO Control Logic
Soft ARM Cortex-M1 Fusion Devices (M1)
ARM Cortex-M1–Enabled
Pigeon Point ATCA IP Support (P1)
Targeted to Pigeon Point Board Management Reference
(BMR) Starter Kits
Designed in Partnership with Pigeon Point Systems
ARM Cortex-M1 Enabled
MicroBlade Advanced Mezzanine Card Support (U1)
Targeted to Advanced Mezzanine Card (AdvancedMC Designs)
Designed in Partnership with MicroBlade
8051-Based Module Management Controller (MMC)
Table 1 Fusion Family
Fusion Devices
AFS090
AFS250
AFS600
AFS1500
ARM Cortex-M1* Devices
M1AFS250
M1AFS600
M1AFS1500
Pigeon Point Devices
P1AFS600
P1AFS1500
MicroBlade Devices
U1AFS250
U1AFS600
U1AFS1500
General
Information
System Gates
90,000
250,000
600,000
1,500,000
Tiles (D-flip-flops)
2,304
6,144
13,824
38,400
Secure (AES) ISP
Yes
PLLs
11
22
Globals
18
Memory
Flash Memory Blocks (2 Mbits)
1
2
4
Total Flash Memory Bits
2M
4M
8M
FlashROM Bits
1,024
RAM Blocks (4,608 bits)
6
8
24
60
RAM kbits
27
36
108
270
Analog and I/Os
Analog Quads
5
6
10
Analog Input Channels
15
18
30
Gate Driver Outputs
5
6
10
I/O Banks (+ JTAG)
4
5
Maximum Digital I/Os
75
114
172
252
Analog I/Os
20
24
40
Note: *Refer to the Cortex-M1 product brief for more information.
Revision 4
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PDF描述
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AFS250-2FG256ES 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs
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