2-38 Revision 4 Table 2-17 VRPSM Signal Descriptions Signal Name Width Dir. Function VRPU 1 In Voltage Regulator Power" />
參數(shù)資料
型號: AFS090-FG256I
廠商: Microsemi SoC
文件頁數(shù): 285/334頁
文件大?。?/td> 0K
描述: IC FPGA 2MB FLASH 90K 256FBGA
標(biāo)準(zhǔn)包裝: 90
系列: Fusion®
RAM 位總計: 27648
輸入/輸出數(shù): 75
門數(shù): 90000
電源電壓: 1.425 V ~ 1.575 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 100°C
封裝/外殼: 256-LBGA
供應(yīng)商設(shè)備封裝: 256-FPBGA(17x17)
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Device Architecture
2-38
Revision 4
Table 2-17 VRPSM Signal Descriptions
Signal Name
Width Dir.
Function
VRPU
1
In Voltage Regulator Power-Up
0 – Voltage regulator disabled. PUB must be floated or pulled up, and
the TRST pin must be grounded to disable the voltage regulator.
1 – Voltage regulator enabled
VRINITSTATE
1
In Voltage Regulator Initial State
Defines the voltage Regulator status upon power-up of the 3.3 V. The
signal is configured by Libero SoC when the VRPSM macro is
generated.
Tie off to 1 – Voltage regulator enables when 3.3 V is powered.
Tie off to 0 – Voltage regulator disables when 3.3 V is powered.
RTCPSMMATCH
1
In RTC Power System Management Match
Connect from RTCPSMATCH signal from RTC in AB
0 transition to 1 turns on the voltage regulator
PUB
1
In External pin, built-in weak pull-up
Power-Up Bar
0 – Enables voltage regulator at all times
TRST*
1
In External pin, JTAG Test Reset
1 – Enables voltage regulator at all times
FPGAGOOD
1
Out Indicator that the FPGA is powered and functional
No need to connect if it is not used.
1 – Indicates that the FPGA is powered up and functional.
0 – Not possible to read by FPGA since it has already powered off.
PUCORE
1
Out Power-Up Core
Inverted signal of PUB. No need to connect if it is not used.
VREN*
1
Out Voltage Regulator Enable
Connected to 1.5 V voltage regulator in Fusion device internally.
0 – Voltage regulator disables
1 – Voltage regulator enables
Note: *Signals are hardwired internally and do not exist in the macro core.
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PDF描述
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AFS090-FGG256IPPX297 制造商:Microsemi Corporation 功能描述:FUSION 90K GATES IND CMOS 3.3V 256 FBGA - Trays