參數(shù)資料
型號： ADV7202
廠商： Analog Devices, Inc.
元件分類： Codec
英文描述： Simultaneous Sampling Video Rate Codec
中文描述： 同時采樣率視頻編解碼器
文件頁數(shù)： 13/26頁
文件大?。?/td> 216K
代理商： ADV7202
REV. PrB
PRELIMINARY TECHNICAL DATA
ADV7202
–13–
Figure 6 shows bus write and read sequences.
S
SLAVE ADDR
A(S)
SUB ADDR
A(S)
DATA
A(S)
DATA
A
(S)
P
S
SLAVE ADDR
A(S)
SUB ADDR
A(S)
DATA
A(M)
DATA
A
(M)
P
S
SLAVE ADDR
A(S)
LSB = 0
LSB = 1
WRITE
SEQUENCE
READ
SEQUENCE
S = START BIT
P = STOP BIT
A(S) = ACKNOWLEDGE BY SLAVE
A(M) = ACKNOWLEDGE BY MASTER
A
(S) = NO ACKNOWLEDGE BY SLAVE
A
(M) = NO ACKNOWLEDGE BY MASTER
Figure 6. Write and Read Sequence
t
3
t
2
t
6
t
1
t
7
t
3
t
4
t
8
SDA
SCL
t
5
Figure 7. I
2
C MPU Port Timing Diagram
t
12
t
11
DAC_CLK1
t
13
DATA
DATA
t
10
DATA [9:0]
DAC_CLK0
t
13
–
HOLD TIME
t
10
–
CLOCK HIGH TIME
t
11
–
CLOCK LOW TIME
t
12
–
SETUP TIME
Figure 8. Input Data Format Timing Diagram Single Clock
t
12
t
12
t
13
t
13
t
10
t
12
t
13
t
11
t
12
t
13
DATA
DATA
DATA
DATA
DAC_CLK0
DAC_CLK1
DAC_DATA[7:0]
t
10
–
CLOCK HIGH TIME
t
11
–
CLOCK LOW TIME
t
12
–
DATA SETUP TIME
t
13
–
DATA HOLD TIME
DATA
Figure 9. Input Data Format Timing Diagram Dual Clock
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PDF描述
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