參數(shù)資料
型號： ADSP-BF544MBBCZ-5M
廠商： Analog Devices Inc
文件頁數(shù)： 40/100頁
文件大小： 0K
描述： IC DSP 16BIT 533MHZ MDDR 400CBGA
標準包裝： 1
系列： Blackfin®
類型： 定點
接口： CAN，SPI，SSP，TWI，UART
時鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 196kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 400-CSPBGA（17x17）
包裝： 托盤
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
Rev. C
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February 2010
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Asynchronous Memory Read Cycle Timing
on Page 45 describe asynchronous memory read cycle opera-
tions for synchronous and for asynchronous ARDY.
Table 28. Asynchronous Memory Read Cycle Timing with Synchronous ARDY
Parameter
Min
Max
Unit
Timing Requirements
tSDAT
DATA15 – 0 Setup Before CLKOUT
5.0
ns
tHDAT
DATA15 – 0 Hold After CLKOUT
0.8
ns
tSARDY
ARDY Setup Before the Falling Edge of CLKOUT
5.0
ns
tHARDY
ARDY Hold After the Falling Edge of CLKOUT
0.0
ns
Switching Characteristics
tDO
Output Delay After CLKOUT
1
6.0
ns
tHO
Output Hold After CLKOUT1
0.3
ns
1 Output pins include AMS3–0, ABE1–0, ADDR19–1, AOE, and ARE.
Figure 13. Asynchronous Memory Read Cycle Timing with Synchronous ARDY
tSARDY
tHARDY
tSARDY
tHARDY
SETUP
2 CYCLES
PROGRAMMED READ
ACCESS 4 CYCLES
ACCESS EXTENDED
3 CYCLES
HOLD
1 CYCLE
tDO
tHO
tDO
tSDAT
tHDAT
CLKOUT
AMSx
ABE1–0
ADDR19–1
AOE
ARE
ARDY
DATA 15–0
tHO
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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