參數(shù)資料
型號(hào)： ADSP-BF537BBCZ-5B
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 29/68頁(yè)
文件大?。?/td> 0K
描述： IC DSP CTLR 16BIT 208CSPBGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點(diǎn)
接口： CAN，SPI，SSP，TWI，UART
時(shí)鐘速率： 500MHz
非易失內(nèi)存： 外部
芯片上RAM： 132kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.26V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 208-CSPBGA
包裝： 托盤(pán)
配用： ADZS-BF537-ASKIT-ND - BOARD EVAL SKIT ADSP-BF537
ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN
ADZS-BF537-EZLITE-ND - BOARD EVAL ADSP-BF537
ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT
ADZS-BF537-STAMP-ND - SYSTEM DEV FOR ADSP-BF537
Rev. J
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February 2014
External DMA Request Timing
Table 28 and Figure 15 describe the external DMA request
operations.
Table 28. External DMA Request Timing
Parameter
Min
Max
Unit
Timing Requirements
tDS
DMARx Asserted to CLKOUT High Setup
6.0
ns
tDH
CLKOUT High to DMARx Deasserted Hold Time
0.0
ns
tDMARACT
DMARx Active Pulse Width
1.0 × tSCLK
ns
tDMARINACT
DMARx Inactive Pulse Width
1.75 × tSCLK
ns
Figure 15. External DMA Request Timing
CLKOUT
tDS
DMAR0/1
(ACTIVE LOW)
DMAR0/1
(ACTIVE HIGH)
tDMARACT
tDMARINACT
tDH
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PDF描述
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參數(shù)描述
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